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芯片工艺面试题及答案

问题1：请解释摩尔定律的核心内容及其在当前半导体工艺中的挑战。

摩尔定律由戈登·摩尔于1965年提出，核心是“集成电路上可容纳的晶体管数目约每18-24个月翻一番，性能也随之提升一倍”。其本质是通过缩小芯片特征尺寸（如栅长、线宽）实现更高集成度和更低单位成本。

当前挑战主要体现在三方面：

（1）物理极限：当特征尺寸缩小至3nm以下时，量子隧穿效应显著，栅极无法有效控制沟道电流，导致漏电流剧增、静态功耗失控；同时，原子级别的工艺波动（如线宽粗糙度、掺杂原子统计涨落）会严重影响器件性能一致性。

（2）工艺复杂度：传统平面晶体管（如PlanarMOSFET）在10nm节点后难以继续缩小，需引入FinFET（鳍式场效应管）、GAA（环绕栅极晶体管）等三维结构，但三维结构的刻蚀精度、薄膜沉积均匀性要求指数级提升。例如，GAA的纳米片间距需控制在5nm以内，刻蚀偏差超过1nm即可能导致器件失效。

（3）成本与收益：先进制程（如3nm、2nm）的生产线投资超百亿美元，EUV光刻机单价约1.5亿美元且产能受限（单台设备每小时仅能处理约125片晶圆），导致芯片设计成本（如掩膜版费用）从14nm的3000万美元激增至3nm的2亿美元以上，中小厂商难以承受。

问题2：光刻工艺中，分辨率的计算公式是什么？制约当前EUV光刻分辨率的关键因素有哪些？

分辨率