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长 沙 学 院 课程设计说明书 题目 洗衣机控制器的设计 系(部) 电子与通信工程系 专业(班级) 电气工程及其自动化2班 姓名 赵健康 学号 2011024212 指导教师 谢明华 起止日期 2013-12-16至2013-12-31 EDA技术课程设计任务书 系（部）：电子与通信工程系 专业：电气工程及其自动化 指导教师：谢明华 课题名称 洗衣机控制器的设计 设计内容及要求 （1）课题内容： 设计一个电子定时器，定时180秒，在这3分钟之内控制洗衣机作如下运转：定时启动(正转20秒(暂停10秒(反转20秒(暂停10秒(定时未到回到“正转20秒(暂停10秒(……”，定时到则停止； 5 二 设计原理及其实现过程 5 2.1设计总原理 5 2.2设计框图 6 2.3 模块设计和相应模块 6 2.3.1 预制时间和减法计数器模块 6 2.3.2数码管动态扫描及状态显示模块 7 2.3.3分频模块 9 三 总电路仿真波形及引脚分配 10 3.1 仿真波形及分析 10 3.2 引脚分配 11 四 测试结果 12 五 课程设计心得 12 六 参考文献 12 一 设计方案 本定时器实际上包含两级定时的概念，一是总洗涤过程的定时，而是在总洗涤过程中又包含电机的正转、反转和暂停三种定时，并且这三种定时是反复循环直至所设定的总定时时间到位置。当总定时时间在0~20min以内设定一个书之后T为高电平1，然后用倒计时的方法每分钟减1直至T变为0。在此期间，若Z1=Z2=1，实现正转；若Z1=Z2=0，实现暂停；若Z1=1,Z2=0,实现反转。实现定时的方法很多，比如采用单稳电路实现定时，又如将定时初值预置到计数器中，使计数器运行在减计数状态，当减到全零时，则定时时间到。如图所示的电路原理框图就是采用这种方法实现的。由秒脉冲发生器产生的时钟信号经60分频后，得到分脉冲信号。洗涤定时的时间的初值先通过拨盘或数码开关设置到洗涤时间计数器中，每当分脉冲到来计数器减1，直至减到定时时间到为止。运行中间，剩余时间经译码后在数码管上进行显示。 二 设计原理及其实现过程 2.1设计总原理 洗衣机控制器的设计主要是定时器的设计。由一片FPGA (Field Programmable Gate Array)和外围电路构成了电器控制部分。FPGA接收键盘的控制命令，控制洗衣机的进水、排水、水位和洗衣机的工作状态、并控制显示工作状态以及设定直流电机速度、正反转控制、制动控制、起停控制和运动状态控制。对FPGA芯片的编程采用模块化的VHDL (硬件描述语言)进行设计，设计分为三层实现，顶层实现整个芯片的功能。顶层和中间层多数是由VHDL的元件例化语句实现。中间层由无刷直流电机控制、运行模式选择、洗涤模式选择、定时器、显示控制、键盘扫描以及对直流电机控制板进行速度设定、正反转控制、启停控制等模块组成，它们分别调用底层模块。 2.2设计框图 2.3 模块设计和相应模块 2.3.1 预制时间和减法计数器模块 由于洗衣机有工作时间，必须要一模块来控制它的工作时间范围，所以我们设计了一个减法计数器模块，当洗衣机开始工作后，减法计数器即会实现减数功能，直到时间减到零，洗衣机便停止工作。 预制时间和减法计数器模块程序 library ieee;use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity count is Port( clk,en,ld:in std_logic); End entity; Architecture one of count is signal c1,c2,c3,a,a1,a2,a3,a4,a5,a6: integer range 15 downto 0; signal b: integer range 5 downto 0; signal clk1,clk2,k:std_logic; process(clk1,ld,en)begin  if en=1 then if (clk1event and clk1=1) then  if k=1 then  if c1=0 and c2=0 and c3=0 then  a1=c1;a2=c2;a3=c3;  else c1=c1-1; if c1=0 then c2=c2-1;c1=9; if c2=0 then c3=c3-1;c2=9; end if;end if; a1=c1;a2=c2