实验报告五.pptVIP

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2017-08-16 发布于贵州
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实验报告五.ppt

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* T1 用一片74LS163计数器和2片74LS138译码器构成一个具有12 路脉冲输出的数据分配器。画出连接图，在图上标明第1 路到第 12 路输出的位置。 Y0 Y1 . . . . . . Y11 译码器 74LS163 CO Q1 Q2 Q3 Q0 D3 D2 D1 D0 LD CR ENP ENT 1 1 1 1 1 1 CP . . . . . . 74LS138 G2A G2B A0 A1 A2 Y7 Y0 Y8 Y9 Y10 Y11 G1 0 74LS138 1 Q0 Q1 Q2 A0 A1 A2 Y7 Y0 Y0 Y3 Y1 Y4 Y2 G1 Y5 G2A G2B Q3 Y6 Y7 74LS163为 4位二进制计数器，同步预置、清零（低有效） T.2 用下图所示的电路结构构成五路脉冲分配器，试分别用最简与非门电路及74LS138集成译码器构成这个译码器，并画出连线图。 [解] 先写出激励方程，然后求得状态方程： 1 1 0 1 1 0 1 0 0 1 0 1 1 1 1 0 1 0 1 1 1 0 1 1 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1 0 1 1 1 Q1n+1 Q2n+1 Q3n+1 Q1n Q2n Q3n Q1n+1 = Q1n + Q3n Q1n = Q1n + Q3n Q2n+1 = Q2n + Q1n Q2n = Q2n + Q1n Q3n+1 = Q1nQ3n + Q2nQ3n CP J K Q J K Q J K Q 1 2 3 CR RD SD Q1 Q2 Q3 RD SD RD SD Y0 Y1 Y2 Y3 Y4 译码器若用与非门实现，译码器输出端的逻辑函数为：若用译码器74LS138实现,译码器输出端的逻辑函数为： 1 1 0 1 1 0 1 0 0 1 0 1 1 1 1 0 1 0 1 1 1 0 1 1 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 0 1 1 1 0 1 1 1 Q1n+1 Q2n+1 Q3n+1 Q1n Q2n Q3n Φ 0 0 0 1 1 0 0 0 1 1 0 0 0 0 0 1 0 0 0 0 0 1 0 0 0 0 0 1 0 0 0 0 0 1 0 1 0 1 0 0 1 1 1 0 1 1 1 0 1 Y0 Y1 Y2 Y3 Y4 Q1n Q2n Q3n 时序电路状态表译码器功能表 Y0 = Q1Q3 Y1 = Q1Q3 Y2 = Q1Q2 Y3 = Q1Q3 Y4 = Q2Q3 000 110 001 010 100 111 011 101 Φ 0 0 0 1 1 0 0 0 1 1 0 0 0 0 0 1 0 0 0 0 0 1 0 0 0 0 0 1 0 0 0 0 0 1 0 1 0 1 0 0 1 1 1 0 1 1 1 0 1 Y0