DSP的特点、发展趋势与应用.docVIP

DSP的特点、发展趋势与应用 发表时间:2006-3-4 9:30:40 【字体：大 中 小】 【编者按】　　　　数字化技术正在极大地改变着我们的生活和体验。作为数字化技术的基石，数字信号处理(DSP)技术已经、正在、并且还将在其中扮演一个不可或缺的角色。DSP的核心是算法与实现，越来越多的人正在认识、熟悉和使用它。因此，理性地评价DSP器件的优缺点，及时了解DSP的现状以及发展趋势，正确使用DSP芯片，才有可能真正发挥出DSP的作用。  --------------------------------------------------------------------------------　　数字化技术正在极大地改变着我们的生活和体验。作为数字化技术的基石，数字信号处理(DSP)技术已经、正在、并且还将在其中扮演一个不可或缺的角色。DSP的核心是算法与实现，越来越多的人正在认识、熟悉和使用它。因此，理性地评价DSP器件的优缺点，及时了解DSP的现状以及发展趋势，正确使用DSP芯片，才有可能真正发挥出DSP的作用。　 　　DSP器件与算法　　 　　DSP(数字信号处理器)作为一种微处理器，其设计的出发点和通用CPU以及MCU等处理器是不同的。DSP是为完成实时数字信号处理任务而设计的，算法的高效实现是DSP器件的设计核心。DSP在体系结构设计方面的很多考虑都可以追溯到算法自身的特点。我们可以通过考察一个FIR滤波器的I/O关系，即，来了解这两者之间的对应关系，如表1所示。　　 　　通过表1，可看出DSP器件和算法之间的必然联系。这不仅是芯片设计人员必须考虑的问题，也是芯片使用者必须了解的。 　　　 　　图1 C62x和C64x DSP内核的数据路径图　　 　　 　　图2 C64x DSP的两级Cache机制　　 　　现代数字信号处理器的特点和发展趋势 　　DSP器件的发展，必须兼顾3P的因素，即性能 (performance) 、功耗 (power consumption) 和价格 (price)。总的来说，随着VLSI技术的高速发展，现代DSP器件在价格显著下降的同时，仍然保持着性能的不断提升和单位运算量的功耗不断降低。下面我们主要以TI公司的DSP为例来说明现代DSP芯片的一些特点和发展趋势。　　 　　通过并行提升DSP芯片的性能　　 　　传统的DSP芯片通过采用乘加单元和改进的哈佛结构，使其运算能力大大超越了传统的微处理器。一个合理的推论是：通过增加片上运算单元的个数以及相应的连接这些运算单元的总线数目，就可以成倍地提升芯片的总体运算能力。当然，这个推论有两个前提条件必须满足：首先是存储器的带宽必须能够满足由于总线数目增加所带来的数据吞吐量的提高；另外，多个功能单元并行工作所涉及的调度算法其复杂度必须是可实现的。 存储器构架的变化　　 　　随着芯片主频的不断攀升，存储器的访问速度日益成为系统性能提升的瓶颈。在现有的制造工艺下，片上存储单元的增加将导致数据线负载电容的增加，影响到数据线上信号的开关时间，这意味着片上高速存储单元的增加将是十分有限的。为了解决存储器速度与CPU内核速度不匹配的问题，高性能的CPU普遍采用Cache(高速缓存)机制，新的DSP芯片也开始采用这种结构。以TI的C64x DSP为例，它采用两级Cache的结构，如图2所示。L1 Cache分为独立的程序缓存 (L1P) 和数据缓存 (L1D) ，其大小各为16KBytes，访问速度与DSP内核的运行时钟相匹配，L2 Cache则采用统一的形式管理，其大小从256KB到1MB不等，访问速度相比L1 cache大大降低。L2 Cache通过DMA与外部低速的存储器件进行数据交换。为增加Cache的命中率，C64x的Cache还采用了多路径的结构形式。研究表明，在很多情况下，采用这种多级缓存的架构可以达到采用完全片上存储器结构的系统约80％的执行效率。但是，采用Cache机制也在一定程度上增加了系统执行时间的不确定性，其对于实时系统的影响需要用户认真地加以分析和评估。 　　Cache对于DSP芯片还是一个比较新的概念。DSP开发人员需要更深入地了解Cache的机制，相应地对算法的数据结构、处理流程以及程序结构等做出调整，以提高Cache的命中率，从而更有效地发挥Cache的作用。　 　　SoC的趋势　 　　对于特定的终端应用，SoC (系统芯片) 可以兼顾体积、功耗和成本等诸多因素，因而逐渐成为芯片设计的主流。DSP器件也逐渐从传统的通用型处理器中分离出更多的直接面向特定应用的SoC器件。这些SoC器件多采用DSP+ARM的双核结构，既可以满足核心算法的实现需求，又能够满足网络传输和用户界面等需求。同时，越