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CP应用程序实验.pdf
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地址:广州市天河区新赛格电子城 A3 栋 15 楼 1505 室: 门市地址:广州新赛格电子城 3 楼 3051 档
LED = 110001;
when 5 =
LED = 100011;
when 6 =
LED = 000111;
when others =
LED = 011111;
end case;
end process;
end Behavioral;
4.2 闪灯鸣叫实验
library IEEE;
use IEEE.STD_LOGIC_1164.ALL;
use IEEE.STD_LOGIC_ARITH.ALL;
use IEEE.STD_LOGIC_UNSIGNED.ALL;
--
-- input clk : 10M
entity cyc_leds is
Port ( sysclk : in std_logic;
led_D : out std_logic_vector(6 DOWNTO 1);
fmq : out std_logic
);
end cyc_leds;
architecture Behavioral of cyc_leds is
signal clock : std_logic;
signal ledcs : std_logic_vector(2 downto 0);
begin
process (sysclk)
主营:DSP 仿真器、学习板、开发板;ARM 仿真器、学习板、开发板;FPGA/CPLD /单片机、仿真器、学习板; 66
销售DSP、C8051FXX、HT46R47全系列芯片;基于 DSP 、ARM 、FPGA/CPLD 及数字语音的项目合作开发
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地址:广州市天河区新赛格电子城 A3 栋 15 楼 1505 室: 门市地址:广州新赛格电子城 3 楼 3051 档
variable divcnt : integer range 0 to 1500000;
begin
if sysclkevent and sysclk = 1 then
divcnt := divcnt + 1;
if divcnt = 1500000 then
clock = not clock;
divcnt := 0;
end if;
end if;
end process;
process (clock)
variable cs_cnt : integer range 0 to 7;
begin
if clockevent and clock = 1 then
cs_cnt := cs_cnt + 1;
end if;
if cs_cnt=7 then
fmq =0;
else fmq =1;
end if;
ledcs = conv_std_logic_vector(cs_cnt, 3);
end process;
process (ledcs)
begin
case ledcs is
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