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2015-09-15 发布于重庆
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SoC芯片中关键路径的优化方法研究.pdf

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维普资讯 2006年第23卷第4期微电子学与计算机 141 SoC芯片中关键路径的优化方法研究李黎付宇卓汪宁 (上海交通大学微电子学院，上海 200030) 摘要：文章对 SoC系统综合时关键路径的处理方法进行了研究，从多路器电路、状态机电路以及算术单元电路三个角度，分析各种实现方式的利弊，提出了在满足系统性能的要求下进行代码设计优化的指导原则和方法，并且用DesignCompiler进行综合并分析其结果。关键词：SoC．综合，RTL优化，关键路径中圈法分类号：TN402 文献标识码：A 文章编号：1000—7180(2006)0,1—141-05 TheOptimizationofCriticalPathinSynthesisofSoC LILi，FUYu-zhuo，WANGNing (SchoolofMicroelectronics，ShanghaiJiaotongUniversity，Shanghai200030) ‘‘ Abstract： Thispaperstudiestheoptimizationofthecriticalpath inSoC synthesis．Theauthorpresentsdifferent implementationmethodsformultiplexercircuit．statemachinecircuitandarithmeticlogicunitcircuit，analyzesthe benefitsandshortagesanddiscusseshow tooptimizetheRrrLdesigntomeethteperformancerequirementofthesystem， Th etimingandarearesultsarealsoanalyzedbyDesignCompiler， Keywords：SoC，Synthesis，RTLoptimization，Crlti~alpaht 1 引言综合出的系统最高工作频率由关键路径决定。硬件描述语言的出现为用户设计更大规模、更只有尽量缩短关键路径的时延．电路的效率才能提高水平的ASIC产品提供了可靠的保证。用HDL语高。言对设计进行RTL级描述的方法，不受工艺限制，然而．由于这种高层次设计方法的重点在于逻缩短了设计时间．大大提高了设计的可重用性。辑验证而非具体的门级实现，虽然提高了设计的效