Nios下的Lvds高速串行接口IP设计与实现.pdfVIP

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2015-09-20 发布于重庆
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Nios下的Lvds高速串行接口IP设计与实现.pdf

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2010 仪表技术与传感器 2010 10 In strum ent T echnique and Sen so r N o10 Nios- II Lvds IP 胡胜宋跃雷瑞庭李君 ( 523808) : 介绍了 N ios- II处理器的外设 IP 的设计方法详细介绍了一种可用于多片 FPGA 板通信的自定义高速串行接口 IP的设计该 IP 采用主从结构使用 L vds 接口进行底层串行数据的高速传输同时给出了相关的驱动程序的编写方法实验表明该 IP 可被无缝整合到各种形式的 SOPC 嵌入式系统中 : N ios- II; IP 设计; 串行数据接口; L vds; FPGA / SO PC; V er ilog : T P274 : A : 1002 - 1841( 2010) 10 - 0054 - 03 IP Design and Realization ofLvdsHighspeed Serial Interface ased on Nios- II HU Sheng SONG Y u e LEI Ru i ting L I Jun (Dongguan University of Technology, Dongguan 523808, China) Abstract:T he design m e thod o f the per iphera l IP b ased on N ios- II processo r w as introdu ced. IP design of h ighspeed ser ia l inter face in m asterslave stru cture w as introdu ced in deta il w h ich cou ld be u sed in comm un ica tion in mo re p ieces of FPGA board in w h ich Lvds in terface w as used for highsp eed se rial da ta tran sm ission in bo ttom lay er. The driv er s w riting m ethod w as also g iv en. Expe rmi en ts show ed tha t th is IP cou ld be seam lessly in teg ra ted into var iou s form s o f the SOPC embedded system s. Keywords: N ios- II; IP des ign; se rial data connec tion; L vds; FPGA / SO PC; V er ilog 0 Lvds Cyc lone II IC L vdsRSD Sm in iL vdsLVPECLSSTL H STL I /O L vds 805 M bit/ s 622 2 (SP II C )