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Cache控制器设计
湖南师范大学职业技术学院（工学院）实验数据报告单
实验课程：计算机组成原理
实验题目：Cache控制器设计实验
实验日期： 2012年 5 月 21 日
一．实验目的
（1）掌握Cache控制器的原理及其设计方法。
（2）熟悉CPLD应用设计及EDA软件的使用。
二．实验内容
利用TD－CMA实验仪设计一个实现直接映射的Cache控制器
三.实验原理
1、采用直接映像方式的cache控制器
图1直接映像方式
2、采用CPU首先访问Cache，若在Cache中找不到目标地址，则从MEM单元中读入到Cache。
CHCHE系统框图
图2 Cache系统框图
3、按区号、块号、块内地址访问目标地址，系统默认存储每个块的首地址，若同时访问同一块中的其他地址，将出现新访问的地址覆盖与之在同一块的另一块号。
四.实验结果与分析
01H 02H 03H 32H 34H 00H 10H 11H 32H 33H 10H
第一次访问01H时指示灯不亮，说明cache未命中，按动KK按钮四次，讲00H-03H装载进入cache。
接下来访问20H的时候指示灯亮，说明cache命中，可以直接访问；访问03H时，指示灯亮，说明cache命中，可以直接访问；访问32H时，灯不亮，因为Cache的块内地址是2位，故初始化时只载入了00H-03H，32H须加载才能访问，按动KK按钮四次，将30H-33H装载进入cache。
访问完32H后，访问34H，cache为命中，按动KK按钮将34H-37H载入cache；
分析：
本次实验主要是采用的地址变换是直接映象方式，主存地址中的块号与Cache地址中的对应块号是完全相同的。主存中的块内地址与Cache地址中的块内地址也是完全相同的。本实验实现的是32位地址的Cache存储器，具体是按区号、块号、块内地址访问目标地址，系统默认存储每个块的首地址，若同时访问同一块中的其他地址，将出现新访问的地址覆盖与之在同一块的另一块号。
实验成绩：
指导老师签名:
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