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项目四 8位加法器电路设计
班级： 姓名： 学号：
实训目标
通过8位加法器的设计，掌握组合逻辑电路的设计方法。
分别使用原理图和文字编辑的方法实现8位加法器的设计，通过电路的仿真和硬件验证，进一步掌握原理图设计与文本设计的过程。
实训步骤
采用原理图编辑法，采用Altera MAX+PLUS II的
采用文本编辑法，即利用VHDL语言描述8位加法器，4位加法器的参考代码如下。
然后对其进行编译，编程器件型号选择ACE1k系列的EP1K30TC144-3，完成程序仿真，记录仿真数据。
由两个并行的4位加法器级联而成。选用原理图编辑发或者文本编辑法实现8位全加器电路。并通过仿真验证。
实训数据
原理图编辑法设计的的电路。
原理图编辑法仿真结果。简述仿真波形的意义。
步骤2、步骤3选做一种，记录电路图或程序。
对设计的8位全加器进行仿真验证，记录仿真结果。简述仿真波形的意义
思考题
仿真结果
湖北轻工职业技术学院 电子设计自动化实训报告
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