《基于DSPBuilder的双三次插值算法FPGA实现的研究》.pdf

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《基于DSPBuilder的双三次插值算法FPGA实现的研究》.pdf

( ) , 2009, 31 (S2) : 85~ 89 CN 53- 1045/ N ISSN 0258- 7971 Journal of Yunnan Uni ersity X DSP Builder FPGA 1 1 2 1 1 谢 然 , 李玉惠, 沈 慧, 李 勃, 陈海飞 ( 11 , 650051; 21 , 6500 31) : DSP Builder DSP FPGA . DSP , F PGA DSP . FP GA ( HDL) DSP 2 . , . : FP GA; M atlab Simulink ; DSP Builder ; : T P 3 12 : A : 025 8- 7971( 2009) S2- 00 85- 05 ( DSP) DSP . D SP , CPU , [ 1] . ( FP GA) , . FPGA , RA MPL LLV DSLVT T L , D SP , F PGA . F PGA , DSP , , FPGA . FP GA DSP ( C, C+ + , M ) , F PGA , . Matlab Simulink DSP Builder , F P- GA . 1 , . , , [ 2] . , , . . , , , , , , , [ 3] . , . , , , , . [4] 4 @ 4 : X : 2009- 06- 04 : ( 1982- ) , , , , FP GA ; E- mail :w ingx ieran@ 1631com : ( 1964- ) , , , , , ( SOP C) ; E- mail: lbly9 177@ 1631com 86 ( ) 31 3 3 5 5 | u | - | u | + 1, 0 [ | u | 1, 2 2 U(u) = 1 3 5 2 ( 1) - 2 | u | + 2 | u | - 4 | u |+ 2, 1 [ | u | 2, 0. 1 , R , A P 16 . x y A R , : R = ( t1A + t2 B + t3 C + t4D) t5 + ( t1E + t2F + t3 G + t4H) t6 + ( t I + t J + t K + t L ) t + ( t M + t + t O + t P) t . (2) 1 2 3 4 7 1 2 3 4 8 t , t , t t R (1) , t ,

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