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第四章 主存储器 4.5.2存储器的基本结构及各部分的功能1、半导体存储器的基本组成 2、单管动态RAM工作原理 主存储器的基本组成与结构 4.8.1 存储器容量的扩展 1、位扩展 2、字扩展 3、字位扩展 如果一个存储容量为M 字?N位 所用芯片规格为L字 ?K位 那么这个存储器共用M/L ?N/K个芯片 例如：要组成16M ?8位的存储器系统， 目前有芯片规格为4M ?1位若干片 需用32片 若有芯片规格为1M ?8位 则需用16片 例如：使用Intel2114芯片（1K*4bit）扩展为4K*8bit存储器 集中刷新的特点： 优点是平均读写周期较短，适用于高速存储器。 缺点是在刷新期间不能访问存储器，有时会影响计算机系统的正常工作。 0 1 2 ………… 3871 3872 ………… 3999 读写操作 刷新 3872周期(1936μ) 128周期(64μ) 刷新间隔 分布式刷新方式： 把每一行的再生分散到各个工作周期中去，一个存储器的系统工作周期分为两个部分，前半部分用于正常的读写、保持；后半部分用于再生某行。这样系统的工作时间增加一倍。 例如计算上例中改为分布刷新的时序关系： 系统的工作周期为：0.5μs＋0.5μs＝1μs 系统的刷新周期为：1μs×128＝128μs WR REF REF …………………… WR REF WR 刷新周期 Tc 0 1 127 分布刷新的特点： 优点是不存在死时间。 缺点是工作周期较长，存储器不能够高速工作。 * * 4.1 存储器和存储系统 存储器： 　　存放计算机程序和数据的设备 存储系统： 　　包括存储器以及管理存储器的软硬件和相应的设备 CPU CACHE 主存（内存） 辅存（外存） 存储系统的层次结构 　　根据各种存储器的存储容量、存取速度和价格比的不同，将它们按照一定的体系结构组织起来，使所放的程序和数据按照一定的层次分布在各种存储器中。 1、主存和高速缓存之间的关系 Cache引入 　　为解决cpu和主存之间的速度差距,提高整机的运算速度,在cpu和主存之间插入的由高速电子器件组成的容量不大,但速度很高的存储器作为缓冲区。 Cache特点 　　存取速度快，容量小，存储控制和管理由硬件实现。 Cache工作原理 　　在较短时间内由程序产生的地址往往集中在存储器逻辑地址空间的很小范围内。（指令分布的连续性和循环程序及子程序的多次执行：程序访问的局部性） 　　数据分布不如指令明显，但对数组的访问及工作单元的选择可使存储地址相对集中。 2、主存与辅存之间的关系 主存(半导体)： 　　优:速度快 　　缺:容量受限,单位成本高,断电丢失信息 辅存(光盘,磁盘) : 　　优:容量大,信息长久保存,单位成本低 　　缺:存取速度慢 数据存储： CPU正在运行的程序和数据存放在主存，暂时不用的程序和数据存放在辅存，辅存只与主存进行数据交换。 4.2 存储器的类型和特点 按存储介质分 　　半导体存储器、磁表面存储器、光存储器 按读写性质分 　　随机读写存储器（RAM） 　　　　静态存储器（SRAM）；动态存储器（DRAM）。 　　 它们存储的内容断电则消失故称为易失性存储器。 　　只读存储器（ROM） 　　　　掩膜型ROM，EPROM，EEPROM。 　　 其内容断电也不消失故称为非易失性存储器。 按在计算机中的层次作用分 　　主存储器、辅助存储器、高速缓冲存储器。 4.3 存储器的主要技术指标 存储容量： 　　存放信息的总数，通常以字节 Byte)为单位B、KB、MB、GB、TB。 存储周期： 　　CPU连续两次访问存储器所需要的最短时间间隔。 最大存取时间: 　　是存储器从接到寻找存储单元的地址码开始,到读出或存入数据为止所需的时间。 存储器的价格： 　　通常以每位价格P来衡量。 其他： 可靠性、存储密度、信息存储的长期性、功耗(分操作功耗和维持功耗)、物理尺寸(集成度)。 4.4 主存储器的基本操作 　　CPU通过AR（地址寄存器）、DR（数据寄存器）和总线与主存进行数据传送。为了从存储器中取一个信息字，CPU必须指定存储器字地址并进行“读”操作，同时等待从主存储器发来的回答信号通知CPU读操作完成、主存储器通过ready线做出回答，若ready信号为“1’，说明存储字的内容已经读出，并放在数据总线上，送入DR、这时“取”数操作完成。 　　为了“存”一个字到主存，CPU先将信息在主存中的地址经AR送地址总线，并将信息字送DR、同时发出‘写’命令。此后，CPU等待写操作完成信