《可编程逻辑器件》课程设计指导书.docVIP

可编程逻辑器件课程设计 张涛 编 蒋伟荣 审 湖北汽车工业学院与信息工程学院信息工程系  课题一 一、1)计价器按1.2元/公里计费，超过10公里后，则按1.8元/公里收费。 (2)起步价6元(3公里)，超过3公里后,计价累加0.6元，10公里内以后每过0.5公里累加0.6元。 (3)过10公里后, 计价累加0.9元, 以后每过0.5公里累加0.9元。 (4)公里数4位数字显示，精确到0.1公里; 出租车计价4位数字显示，精确到0.1元。 (5)计费器按里程收费，每100米开始一次计费。 2、实现预置功能：能预置起步费。 3、实现模拟功能：能模拟汽车启动、停止、暂停、车速等状态。 4、设计动态扫描电路：将车费显示出来，有两位小数。 5、用VHDL语言设计符合上述功能要求的出租车计费器，并用层次化设计方法设计该电路。 6、各计数器的计数状态用功能仿真的方法验证，并通过有关波形确认电路设计是否正确。 7、完成电路全部设计后，通过系统实验箱下载验证设计课题的正确性。 二、 三、报告要求 1、画出顶层原理图或者用VHDL语言写出顶层文件。 2、画出各模块原理图并用VHDL语言描述之。 3、画出（或打印出）有关仿真文件及仿真波形图。 4、叙述顶层原理图工作原理。 课题二 带整点报时的时钟设计 一、⑴按下“SA”键时，计时器迅速递增，并按24小时循环，计满23小时后回“00”； ⑵按下“SB”键时，计分器迅速递增，并按59分钟循环，计满59分钟后回“00”，但不向“时”进位； ⑶按下“SC”键时，秒清零； ⑷要求按下“SA”、“SB”或“SC”时均不产生数字跳变（SA”、“SB”、“SC”按键是有抖动的，必须对其消除抖动处理）。 3、能利用扬声器做整点报时： ⑴当计时到达59分50秒时开始报时，在59分50秒、52秒、54秒、56秒、58秒鸣叫，鸣叫声频率可定为500Hz； ⑵到达59分60秒时为最后一声整点报时，整点报时频率可定为1KHz。 4、用层次化设计方法设计该电路，用VHDL语言编写各个功能模块。 5、报时功能、闹时功能用功能仿真的方法验证，可通过观察有关波形确认电路设计是否正确。 6、完成电路设计后，用实验系统下载验证。 二、 模块电路功能如下： 1、秒计数器、分计数器、时计数器组成了最基本的数字钟计时电路，其计数输出送7段译码电路由数码管显示。 2、基准频率分频器可分频出标准的1Hz频率信号，用于秒计数的时钟信号；分频出4Hz频率信号，用于校时、校分的快速递增信号；分频出64Hz频率信号，用于消除按动“校时”、“校分”按键的抖动。 3、MUX模块是二选一数据选择器，用于校时、校分与正常计时的选择。 4、HADJ、HAOJ、SCLR模块实际上是一个能完成消除抖动的D触发器。64Hz信号作为该触发器的时钟，SA、SB、SC是包含抖动的输入信号，而模块的输出则是一个边沿整齐的输出信号。 5、报时电路模块需要500Hz信号通过一个组合电路完成功能，前五声鸣叫功能报时电路还需要一个触发器来保证整点报时时间为1秒。 6、闹时电路模块也需要500Hz或1KHz音频信号以及来自秒计数器、分计数器和时计数器的输出信号作为本电路的输入信号。 7、闹时电路模块的工作原理如下：按下闹时设置按键SD后，将一个闹时数据存入D触发器内。时钟正常运行，D触发器内存的闹时时间与正在运行的时间进行比较，当比较的结果相同时，输出一个启动信号触发一分钟闹时电路工作，输出音频信号。 三、报告要求 1、画出顶层原理图或者用VHDL语言写出顶层文件。 2、对照多功能数字钟框图分析电路工作原理。 3、写出各个功能模块的VHDL语言源文件。 4、叙述各个模块的工作原理。 5、说明按键消除抖动电路的工作原理，画出有关波形。 6、叙述闹时电路的工作原理，绘出详细电路或框图，并写出VHDL语言源文件，画出有关波形。 课题三 自动频率计设计 一、 二、 模块电路功能如下： 1、每次测量时，用由时钟信号产生的闸门信号启动计数器，对输入脉冲信号计数，闸门信号结束立即将计数结果送入锁存器，然后计数器清零，准备下一次计数。但下一次计数的开始，须等待设定的显示时间结束。为与时钟信号同步，在此时间结束后还有一段准备时间。 2、显示电路为8位动态扫描电路，可以参阅以前的动态扫描电路。 3、计数器可由8个十进制加法计数器级联而成。 4、锁存器为一保持电路，需要有32位，实际上就是一个32位的D触发器。 5、分频器用来产生需要的频率信号。 6、控制器用来产生作用于锁存器的锁存信号和计数器的使能信号与清零信号。 三、报告要求 1、画出顶层原理图或者用VHDL语言写出顶层文件。 2、写出各个功能模块的VHDL语言源文件。 3、对照频率计波形图分析电路工作原理。 4、叙述各个模块的工作原理。 5、