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洗衣机-verilog
课程设计
实验项目名称 基于FGPA的洗衣机自动控制程序
年 级 2013级
专 业 电路与系统
学生姓名 石安伟
学 号 201304703004
数字逻辑系统设计
三、确定各状态的程序结构
1、await状态:
if(startk)
进入pump状态
else
begin
为各项参数及输出量赋初值
end
2、pump状态:
if(wlh)
进入wash状态
else
if(tt==3)
返回await状态并将alartk打开
else
停留在pump状态并将pumpk打开
3、wash状态:
if(t5分钟)
进入排水状态
else
begin
停留在wash状态并关闭pumpk
总时间t开始计数
if((t10)(t120s))
电机正转
else
if((t123s)(t143s))
电机反转
else
电机停转
end
4、drain状态:
if(wll)
进入甩干状态
else
停留在drain状态
将draink打开
电机关停
t,t1置零
5、spin状态:
if(t2)
t2开始计数并将spink打开
else
t2置初值60s
洗涤次数tt+1
关闭spink及draink
返回pump状态
四、完整程序代码
1、顶层模块
`includecontrol.v
`includefenpin.v
module washmachine(clk,rst,startk,wlh,wll,pumpk,wrk,wfk,draink,spink,alartk);
input clk,rst,startk,wlh,wll;
output pumpk,wrk,wfk,draink,spink,alartk;
wire clklnk; //实现control模块的输入clk与fenpin模块的输出clko的连接
control c1(clklnk,rst,startk,wlh,wll,pumpk,wrk,wfk,draink,spink,alartk);
fenpin f1(clk,clklnk);
endmodule
2、100Hz分频模块
module fenpin(clki,clko);
input clki;
output clko;
reg clko;
reg [31:0] out;
initial clko=0;
always@(posedge clki)
if(out==200000)
begin
clko=!clko; //若out加到200k,则clko反转,每个脉冲周期为400K,输出100Hz
out=0;
end
else
out=out+1;
endmodule
3、自动洗涤控制模块
module control(clk,rst,startk,wlh,wll,pumpk,wrk,wfk,draink,spink,alartk);
input clk,rst,startk,wlh,wll;
output pumpk,wrk,wfk,draink,spink,alartk;
reg[4:0] state;
reg pumpk,wrk,wfk,draink,spink,alartk;
reg[31:0] t,t1,t2,tt;
parameter
await=5b10000,
pump=5b01000,
wash=5b00100,
drain=5b00010,
spin=5b00001;
//-------------------------------------状态独热码-------------------------------------
always @(posedge clk)
if(rst)
begin
state=await;
t=0;
t1=0;
t2=6000;
tt=0;
pumpk=0;
wrk=0;
wfk=0;
draink=0;
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