bu di * 基于FPGA的高速数据交换模块设计 学生:李琛 学号 老师:王虹现 (中期报告) 报告内容 课题概述 工作进度汇报 后期工作安排 课题概述 背景及意义:当今高速实时信号处理系统中,涉及的对象趋于多 样化,这些不同类型的数据常常需要在信号处理系统中不同功能模 块之间进行通信交换与传输,为了满足这种大规模实时信号多种数 据流传输的要求,设计一种FPGA多数据交换系统 系统结构 1、软件编程及仿真 2、硬件测试 总体结构设计: 说明:为了适应多种速率数据传输要求,系统除了包括ADC 和DAC,还集成多种数 据通信接口。从数据传输速率的角度分类,既有光纤、串行RapidIO 和自定义专用 高速数据传输通道(LINK通道)这样适于大带宽数据传输的高速接口,又有相对较低 数据传输速率的PCI、UAR等接口 核心部分:数据交换模块设计 1.主要作用: 从各个模块的输出端口接收数据; 决定数据是否经过存储然后转发; 将数据发送到各模块的输入端口; 2.主要结构: 提供公共的可配置的控制/状态寄存器组; 对各个模块的输入输出数据流进行分配和连接; 输出各个模块的控制信号; 提供FIFO 或RAM 对各个模块的数据进行缓存或处理; 工作进度汇报 我的计划: 学习FPGA、 编程等相关知识 我的计划:
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