数电实验之计数器.docVIP

PAGE 4 PAGE 5 计数器 一 实验目的 掌握中规模集成计数器的逻辑功能及使用方法。 学习运用集成电路芯片计数器构成N位十进制计数器的方法。 二 实验原理 计数器是一个用以实现计数功能的时序器件，它不仅可以用来记忆脉冲的个数，还常用于数字系统的定时、分频和执行数字运算以及其它特定的逻辑功能。 计数器种类很多，按构成计数器中的各个触发器输出状态更新是否受同一个CP脉冲控制来分，有同步和异步计数器，根据计数制的不同，分为二进制、十进制和任意进制计数器。根据计数的增减趋势分，又分为加法、减法和可逆计数器。另外，还有可预置数和可编程功能的计数器等。目前，无论是TTL还是CMOS集成电路，都有品种较齐全的中规模集成计数器芯片。如：异步十进制计数器74LS90，4位二进制同步计数器74LS93，CD4520，4位十进制计数器74LS160、74LS162；4位二进制可预置同步计数器CD40161、74LS161、74LS163；4位二进制可预置同步加/减计数器CD4510、CD4516、74LS191、74LS193；BCD码十进制同步加/减计数器74LS190、74LS192、CD40192等。使用者只要借助于器件手册提供的功能表和工作波形图以及引出端的排列就能正确使用这些器件。 例如74LS192同步十进制可逆计数器，具有双时钟输入十进制可逆计数功能；异步并行置数功能；保持功能和异步清零功能。74192功能见表19.1中。 输 入 输 出 注CR CPU CPD D3 D2 D1 D0 Q3n+1 Q2n+1 Q1n+1 Q0n+1 1 X X X X X X X 0 0 X X d3 d2 d1 d0 0 1 ↑ 1 X X X X 0 1 1 ↑ X X X X 0 1 1 1 X X X X 0 0 0 0 d3 d2 d1 d0 加 法 计 数 减 法 计 数 保 持异步清零 异步置数 表19.1 *表中符号和引脚符号的对应关系： CR = CLR—清零端； = LOAD—置数端（装载端） CPU = UP—加计数脉冲输入端 CPD = DOWN—减计数脉冲输入端 —— 非同步进位输出端（低电平有效） ——非同步借位输出端（低电平有效） D3 D2 D1 D0 = D C B A—计数器数据输入端 QD QC QB QA—计数器数据输出端 根据功能表我们可以设计一个特殊的12进制的计数器，且无0数。??图19.1所示：当计数器计到13时，通过与非门产生一个复位信号，使第二片74LS192（时十位）直接置成0000，而第一片74LS192计时的个位直接置成0001；从而实现了1——12的计数。注：将第一片74LS192的输出QD QC QB QA接到实验箱中显示译码器的输入端D、C、B、A；其它按下图连接即可验证电路的正确性。 图19.1 三 实验器件 数字实验箱 集成电路芯片 74LS160×2 ；74LS192×2；74LS00 ；74LS163×2 集成电路引脚如图19.2所示 图19.2 四 实验内容 测试74LS163计数器的逻辑功能。 74LS163为二进制4位并行输出的计数器，它有并行装载输入和同步清零输入端。74LS163的技术参数： 电源电压 VCC=+5V； 应用、测试温度范围 0—74℃； 输入时钟频率 25MHz； 时钟脉冲宽度 25ns； 清零时钟脉冲宽度20ns。 74LS163功能见表19.2： 输 入输 出  ENP ENT CP D3 D2 D1 D0Q3n+1Q2n+1Q1n+1Q0n+1RCO X X X ↑ X X X X 1 1 X X ↑ d3 d2 d1 d0 1 1 1 1 ↑ X X X X 1 1 0 X X X X X X 1 1 X 0 X X X X X 0 0 0 0 d3 d2 d1 d0 计 数 保 持 保 持 0 0表19.2 1、根据功能表依次验证74LS163的逻辑功能。 2、改变这个二进制计数器为十进制计数器，连接线如下图，即用一个与非门，其两个输入取自QA和QD