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FPGA课程设计 报 告 书 题 目：基于FPGA多功能电子钟设计 学 院： 电气工程与自动化 专业班级： 电信12-3班 指导老师： 李辉 设计作者： 黄晨 学 号： 311208002013 完成日期： 2016年12月8日 目 录 摘 要 1  TOC \o 1-3 \h \z \u  HYPERLINK \l _Toc264892413 第一章 FPGA简介 2  HYPERLINK \l _Toc264892415 1.2 FPGA基本结构 2  HYPERLINK \l _Toc264892416 1.3 FPGA系统设计流程 3  HYPERLINK \l _Toc170046537 第二章 系统电路设计 4  HYPERLINK \l _Toc170046536 2.1电子钟的设计方案选择 4  HYPERLINK \l _Toc170046538 2.2总体设计方案 4  HYPERLINK \l _Toc170046539 2.3显示电路设计 5  HYPERLINK \l _Toc170046540 2.3.1分频器电路 7  HYPERLINK \l _Toc170046541 2.3.2扫描电路电路 7  HYPERLINK \l _Toc170046542 2.3.3 BCD码多路选择器 7  HYPERLINK \l _Toc170046543 2.3.4 BCD译码器 7  HYPERLINK \l _Toc170046544 2.3.5位选码电路 8  HYPERLINK \l _Toc170046545 2.4电子时钟计数器电路设计 8  HYPERLINK \l _Toc170046546 2.4.1秒和分计数器设计 8  HYPERLINK \l _Toc170046547 2.4.2小时计数器设计 10  HYPERLINK \l _Toc170046548 总 结 12  HYPERLINK \l _Toc295940568 参考文献 13 附录 HYPERLINK \l _Toc296945241  14  PAGE \* MERGEFORMAT 24 摘 要 本文介绍了多功能电子钟的现状及发展动态，多功能电子钟的应用，多功能电子钟的基本原理和实现方法以及系统构建理论。针对现行电子钟设计方案实现起来相对复杂、误差偏大等弊端，对以FPGA为核心器件的电子钟方案进行了实验研究，利用EDA技术自顶向下的设计方法，设计电子钟各模块及相应具体电路，通过编译、仿真并下载到FPGA实验平台进行测试，运行结果表明：系统能以较小的误差显示时、分、秒，并且当走时不准时，可以通过相应设置键实现校时。  关键词：多功能电子钟；EDA；FPGA 第一章 FPGA简介 1.1 FPGA概述 FPGA是现场可编程门阵列（Field Programmable Gate Array）的简称，与之相应的CPLD是复杂可编程逻辑器件（Complex Programmable Logic Device）的简称，两者的功能基本相同，只是实现原理略有不同，有时可以忽略这两者的区别，统称为可编程逻辑器件或CPLD/PGFA。CPLD/PGFA几乎能完成任何数字器件的功能，上至高性能CPU，下至简单的74电路。它如同一张白纸或是一堆积木，工程师可以通过传统的原理图输入或硬件描述语言自由的设计一个数字系统。通过软件仿真可以事先验证设计的正确性，在PCB完成以后，利用CPLD/FPGA的在线修改功能，随时修改设计而不必改动硬件电路。使用CPLD/FPGA开发数字电路，可以大大缩短设计时间，减少PCB面积，提高系统的可靠性。这些优点使得CPLD/FPGA技术在20世纪90年代以后得到飞速的发展，同时也大大推动了EDA软件和硬件描述语言HDL的进步。 1.2 FPGA基本结构 FPGA具有掩膜可编程门阵列的通用结构，它由逻辑功能块排成阵列，并由可编程的互连资源连接这些逻辑功能块来实现不同的设计。 FPGA一般由3种可编程电路和一个用于存放编程数据的静态存储器SRAM组成。这3种可编程电路是：可编程逻辑