数字逻辑实验-集成译码器极其应用及二进制并行加法器.docVIP

数字逻辑实验-集成译码器极其应用及二进制并行加法器.doc

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数字逻辑实验-集成译码器极其应用及二进制并行加法器

武汉大学计算机学院教学实验报告 课程名称 数字逻辑实验 成 绩 教师签名 实验名称 集成译码器极其应用及二进制并行加法器 实验序号 1 实验日期 2015 姓 名 学 号 专 业 年级-班 实验目的及实验内容 (本次实验所涉及并要求掌握的知识;实验内容;必要的原理分析) 小题分: 实验目的:集成译码器极其应用: 1.掌握二进制译码器。 2.熟悉集成译码器的应用方法。 3.熟悉集成译码器的扩展方法。 二进制并行加法器: 熟悉集成加法器。 了解集成加法器的应用。 实验内容:集成译码器极其应用: 1. 74ls138功能测试。 二进制并行加法器: 1.74ls283的功能测试。 2.用74ls283和74ls86实现4位二进制并行加/减法器。 实验环境及实验步骤 (本次实验所使用的器件、仪器设备等的情况;具体的实验步骤) 小题分: 实验环境:1.TD-DS数字逻辑实验台1台。 2.74ls138。 3.74ls283。 4.基本门电路。 实验步骤: 集成译码器极其应用: 1.将74ls138输出接实验台上的电平显示单元,变量A2A1A0接实验上逻辑电平开关单元,使能端接固定电平(VCC接地)。 2.S1S2S3不等于0时,任意波动开关,观察LED显示状态,记录实验结果。 S1S2S3等于0时,按二进制顺序拨动 A2A1A0所接开关,观察LED显示状态,并与功能表对照,记录实验结果。 二进制并行加法器: 1.用1片4位二进制并行加法器74LS283和1片74LS286(四二输入异或门)实现一个二进制并行加法器/减法器。画出接线图并在试验台上测试之。 实验过程分析 (详细记录实验过程中发生的故障和问题,进行故障分析,说明故障排除的过程及方法。根据具体实验,记录、整理相应的数据表格、绘制曲线、波形等) 小题分: 集成译码器极其应用: 在进行步骤3(S1S2S3等于0时,按二进制顺序拨动 A2A1A0所接开关,观察LED显示状态,并与功能表对照,记录实验结果)时,发现结果与功能表不一样,本应是A灯亮,但是B灯亮了。检查电路也没有问题。换了几根线后无此问题,发现是接线时某些线和接口没有接紧。 二进制并行加法器: 2.实验很顺利,一次成功。 实验结果总结 (对实验结果进行分析,完成思考题目,总结实验的新的体会,并提出实验的改进意见) 小题分: 实验结果总结: 掌握了二进制译码器。 学会了用74ls283和74ls86实现4位二进制并行加/减法器。 学会了排查实验中简单的错误。

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