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PowerPC的外部中断处理
PowerPC的外部中断处理
异常
异常是e500mc核产生的,它是同步产生的(可以预知的),如非法指令,或访问存储器时出现TLB Miss等情况。
中断
中断是e500mc核外部引脚产生的中断,由PIC送进来的,它是异步产生的(无法预知的),主要有:int#, cint#, mcp# 。
? 2011 虹信通信
2
中断与异常
MSR(Machine State Register)寄存器。用于设置e500mc的当前使用状态,初始化CPU时第一个设置的寄存器。CE(Critical Enable,第46位),ME(Machine Check Enable,第51位),DE(Debug Interrupt Enable,第54位)。用于使能和关闭Critical异常,Machine check异常和Debug异常。EE(External Enable,第48位)。为1时使能外部中断,为0时屏蔽外部中断。PR(第49位)。为0表示处理器在内核模式,为1表示处理器在用户模式。IS,DS(第58,59位)。e500mc支持两个地址空间——0和1。IS为0表示当前程序使用指令空间0,为1表示当前程序使用指令空间1;DS为0表示当前程序使用数据空间0,为1表示当前程序使用数据空间1。
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3
寄存器
中断向量是指中断或者异常程序的入口地址。一系列的中断向量号构成中断向量表。对于e500mc内核,中断处理程序的入口地址为虚拟地址。Linux PowerPC使用e500mc内核的地址空间0保存这些虚拟地址。这也是为什么要清除PR,IS,DS位的原因。
在e500mc内核中,使用IVPR和IVORx寄存器共同确定中断和异常程序的入口地址。
中断入口地址的计算方法:
IVPR[32-47] || IVPORn[48-59] || 0b0000
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4
寄存器
e500mc内核的中断向量表
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5
寄存器
中断向量表中4号中断是外部中断,对应的中断处理函数是ExternalInput。
IVORs
Interrupt type
IVOR0
Critical interrupt
IVOR1
Machine check
…
…
IVOR4
External input
…
…
IVOR15
Debug
…
…
MSK: 若置1,此中断源的中断被无视.
A: 若置1,此中断源有中断发生
P: 若置1, active-high; 若置0, active-low.
S: 若置1,此中断是水平触发。若置0,此中断是边界触发
PRIORITY: 优先级0-15。15是最高优先级,0时相当于无视此中断。
VECTOR: 硬件中断号。中断发生后处于pengding时,此字段被写在IACK中。
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6
寄存器
CTPR(Processor Current Task Priority Register)寄存器。该寄存器存放当前CPU中运行任务的级别。
? 2011 虹信通信
7
寄存器
M位为0,表示当前中断控制器PIC被旁路,此时IRQ0引脚监测到的中断信息将直接送入到CPU。
? 2011 虹信通信
8
寄存器
该寄存器用来存放当前中断源的硬件中断号,是e500mc内核外部中断处理的一个重要寄存器。当处理器对此寄存器进行读操作时,将启动外部中断响应周期。
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9
寄存器
SRR0 (Save/Restore Register 0)
64 bit,用于异常发生时保存引起异常指令的地址(异常)或其下一条指令的地址(中断)。保存过程硬件自动做执行 rfi 从异常返回时,处理器会跳转到 SRR0 保存的地址处继续执行。
SRR1(Save/Restore Register 1)
32 bit,用于异常发生时硬件自动保存 MSR (Machine Status Register)。 执行 rfi 从异常返回时,处理器会将 SRR1 值恢复入 MSR。
EOI(End of Interrupt Register)
该寄存器只有“EOI CODE”字段有效,对此字段写入0b0000将结束当前中断的处理。
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10
寄存器
捕捉到外部中断信号#cint,#int。
保存被中断程序的返回地址到SRR0寄存器中。
保存MSR寄存器到SRR1中,如果是地址异常还会保存错误地址到DEAR寄存器中。
保留MSR寄存器中的CE,DE,ME位,其余全部清除。因此,e500mc在处理外部中断时,还可以被Critical中断,调试中断和Machine Check中断重入。
清除PR,IS,DS位。此时,处理器运行在内核模式。
根据IVPR和IVO
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