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2.1常用组合逻辑部件分析
译码器
数据选择器
数据分配器
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译码器
2.1.1译码器
译码——把具有特定含义的二进制代码识别出来的过程
译码器是编码器的逆过程,在数字系统中,编码器和译码器成对存在
译码器——
? 特点:多输入、多输出的组合逻辑电路
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(2)特点 :
▲ 二进制译码器一般具有n个输入端、2n个输出端和一个(或多个)使能输入端;
▲ 使能输入端为有效电平时,对应每一组输入代码,仅一个输出端为有效电平,其余输出端为无效电平(与有效电平相反)。
▲ 有效电平可以是高电平(称为高电平译码),也可以是低电平(称为低电平译码)。
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? 常见的MSI二进制译码器:
2-4线(2输入4输出)译码器
3-8线(3输入8输出)译码器
4-16线(4输入16输出)译码器等。
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例:3-8译码器
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译码器应用
译码器在数字系统中的应用非常广泛 ,它的典型用途是——
(1)实现存储器的地址译码、控制器中的指令译码、代码翻译、显示译码等。
(2)除此之外,还可用译码器实现各种组合逻辑功能。
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2.1.3 数据分配器(DEMUX)
? 数据分配器功能:
① 也称多路分配器,是一路输入、多路输出的组合逻辑器件;
② 一路输入信号传送到哪一路输出端由当时的控制信号决定;
? 数据分配器用途:
与数据选择器的用途相反,它们配合使用,实现多通道的数据传送;
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2.2 时序逻辑
◎什么是时序逻辑
◎锁存器(Latch)
◎触发器(Flip Flop)
◎寄存器(Register)
◎计数器(Counter)
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组合电路是:电路某一时刻的输出(Z1,…,Zm)仅仅决定于该时刻的输入(x1,…,xn),与以前各时刻的输入无关。
时序电路是:电路某一时刻的输出(Z1,…,Zm)不仅决定于该时刻的输入(x1,…,xn),还与前一时刻的状态 (y1,…,ys) 有关。前一时刻的状态就是存储电路的输出。
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二、分类
1、按动作特点分类:
(即按FF状态更新是否受同一时钟脉冲控制分类):
(1)同步时序逻辑电路:同一CP
(2)异步时序逻辑电路:不同CP
2、按输出信号的特点分类:(即组合电路的繁简程度)
(1)Mealy(米里)型:输出取决于电路的状态,即输入
Y(tn)=F[X(tn),Q(tn)]
(2)Moore(摩尔)型:输出仅仅取决于电路的状态
Y(tn)=F[Q(tn)]
注:有些电路没有组合逻辑电路;有些电路没有输入信号。
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2.2.1 触发器概述
数字电路不仅需要运算,还需要保存、记忆。
存储一位二值信号的基本单元电路称为触发器
1、触发器的基本特点:
(1)具有两个能自行保持的稳定状态,表示逻辑0和1,
或二进制数的0和1。
(2)根据不同的输入信号可以置成1或0。
2、触发器的分类
(1)、按结构分类:
基本RS触发器,同步RS触发器,
主从触发器,维持阻塞触发器,边沿触发器
(2)、按功能分类:
RS触发器,JK触发器,D触发器,T触发器
(3)、按触发方式分:电位触发方式、
主从触发方式及边沿触发方式。
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(4)逻辑符号
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(4)逻辑符号
(4)逻辑符号
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3.2.2.2 计数器
? 计数器在数字系统中应用十分广泛,是一种具有记忆功能的电路,用以累计输入脉冲的个数、实现计数操作功能,通常用触发器构成各种形式的计数器。
幻灯片41-43 计数器的分类
1.? 按进位方式分
(1)同步计数器:有一个公共时钟脉冲,各个触发器的状态转换是在该公共输入计数脉冲作用下同时发生的,即各个触发器状态的翻转与输入脉冲同步。
(2)异步计数器:没有公共时钟脉冲,输入计数脉冲只作用于某些触发器的CP端,而其它触发器的翻转是靠低位的进位信号。因此,组成计数器的各个触发器的状态变化不是同时发生的。
2.按进位制分
(1)二进制计数器:按二进制数运算规律进行计数的电路称作二进制计数器。
(2)十进制计数器:按十进
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