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/* Based on CPU DB MC9S12XS256_112, version 3.00.008 (RegistersPrg V2.26) */
/*
** ###################################################################
** Filename : mc9s12xs128.h
** Processor : MC9S12XS128CAL
** FileFormat: V2.26
** DataSheet : MC9S12XS256RMV1 Rev. 1.03 06/2008
** Compiler : CodeWarrior compiler
** Date/Time : 23.2.2009, 15:08
** Abstract :
** This header implements the mapping of I/O devices.
**
** (c) Copyright UNIS, a.s. 1997-2009
** UNIS, a.s.
** Jundrovska 33
** 624 00 Brno
** Czech Republic
** http :
** mail : info@
**
** CPU Registers Revisions:
** - 20.02.2008, V3.00.0:
** - Corrected registers address: ATD0DIENL 0x02CC = 0x02CD
** - Removed bit FSTAT[RSVD].
** - REASON: Changes in the data sheet (from Rev. 1.00 5/2007 to Rev. 1.01 8/2007).
** - 17.04.2008, V3.00.1:
** - Renamed registers TCNTH/L == TCNTHi/Lo, TCxH/L == TCxHi/Lo.
** - REASON: Bug-fix (#6048 from the UNIS Issue Manager).
** - 21.05.2008, V3.00.2:
** - Added register VREGHTTR. Added interrupt vector Vhti.
** - REASON: Changes in the data sheet (from Rev. 1.01 08/2007 to Rev. 1.02 02/2008).
** - 23.02.2009, V3.00.3:
** - Corrected definition of 16-bit Port AD0 registers to use properly AD0L/AD0H parts.
** - REASON: Bug-fix (#7029 in UNIS Issue Manager).
**
** File-Format-Revisions:
** - 19.07.2007, V2.18 :
** - Improved number of blanked lines inside register structures
** - 06.08.2007, V2.19 :
** - CPUDB revisions generated ahead of the file-format revisions.
** - 11.09.2007, V2.20 :
** - Added comment about initialization of unbonded pins.
** - 02.01.2008, V2.21 :
** - Changes have not affected this file (because they are related to another family)
** - 13.02.2008, V2.2
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