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基于VerilogHDL语言的FPGA设计 课程作业 学院：电子工程学院 专业班级：微电子10级？班 姓名：？？？学号：？？？？？？？？ 姓名：？？？学号：？？？？？？？？ 姓名：？？？学号：？？？？？？？？ 姓名：？？？学号：？？？？？？？？ 作业题目：？？？？？？？？ 完成日期：2013年？月？日 一、设计要求 1 二、规范说明 1 三、顶层设计结构图 1 四、模块详细设计 2 1 功能说明 2 2 端口定义 2 3 设计代码 2 4 激励代码 2 5 仿真结果 3 五、结论和问题： 3 六、团队成员分工： 3 （正文都使用宋体，五号，黑色标准字体，模板中蓝色字体为填写说明和范例，请删除后自行填写） 一、设计要求 （简要说明设计需要实现的功能） 二、规范说明 （详细定义设计目标模块的要求，可以使用信号定义，功能表，真值表等设计目标文件） 三、顶层设计结构图 如果有多个模块，请用图示说明模块之间的关系。 四、模块详细设计 1 功能说明 （简要说明设计目标模块功能，可以添加管脚分配，功能表，真值表等设计目标文件） 2 端口定义 信号名称（包含名称和位数） 信号类型（输入，输出或者双向） 详细说明（包括时钟的频率，占空比，复位信号的类型，有效电平，数据信号的采样沿和输出沿，以及和目标设计不