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VHDL ----- Quartus II（11.1版本）调用Modelsim进行仿真 之前仿真一直是用Quartus II自带的“Vector Waveform File”，但因其功能有限，在老师的推荐下接触了Modelsim,捣腾了一段时间之后总算有所收获了。在查资料的过程中，发现好多二者联合的讲解都是用Verilog语言写的例子，而VHDL很少。以下是我总结的用VHDL语言的具体步骤以及要注意的细节～～坎坷的路就略过了，直接展示成果。 例子是‘八位七段数码管的动态扫描显示’ 用Quartus II 进行VHDL语言编译 首先建立工程 File-New project Wizard（第三个图标） 填入所建工程的目录以及名称，注意稍后的源程序中实体名必须和这里的名称相同。填好后单击finish，然后单击yes。 新建VHDL源程序文件 File-New-VHDL File-OK 将程序写进去（这里只讲步骤，不讲源程序的写法） 注意：程序中的实体名必须和之前建工程时所命名的文件名相同！ 然后保存一下，不用改动，直接单击保存。 编译 快捷键按钮在界面中上方的红色倒三角，显示编译成功之后关闭编译报告。 4.设备设置 具体的实验器件根据提供的实验板设定 Assignment-Device 引脚分配 Assignme