[第九讲数字跑表模块设计.pptVIP

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2017-01-07 发布于北京
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[第九讲数字跑表模块设计

任务要求设计一个数字跑表，实现“百分秒”、“秒”和“分”的计时及显示。“秒”和“分”能实现从“00”到“59”的循环计数；“百分秒”能实现从“00”到“99”的循环计数。时间显示利用的是开发板上提供的LED数码显示器。时钟信号来源于开发板提供的时钟信号。具有复位、暂停、秒表计数的功能；任务分析模块划分分频模块计数模块显示控制确定FPGA的规格设计方案接口信号定义设计输入功能仿真目的：对设计进行不带器件延时信息的逻辑功能仿真，验证电路功能是否满足设计要求功能仿真---编写testbench 仿真波形电路综合综合之后的部分原理图布局布线布局：将综合输出的逻辑网表适配到具体FPGA器件的物理单元上布线：实现FPGA器件元件之间的互连布局布线之后的电路图 CLB的结构 IOB的结构 Bit文件生成、加载、系统调试数字跑表设计赵杰 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 图1 数字跑表的系统框图 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 编号 1 2 3 规格复位信号高有效，对系统异步清零暂停信号低电平秒表计数，高电平停止计数百分秒、秒、分钟计数均采用BCD码计数方式 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 百分秒计数器秒计数器分计数器 flag1 flag2 pause 跑表模块 clk reset ms_h ms_l s_h s_l m_h m_l Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 秒计数器分计数器 flag pause reset s_h[3:0] s_l[3:0] m_h[3:0] m_l[3:0] clk Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 信号名 clk reset pause ms_h ms_l s_h s_l m_h m_l I/O I I I O O O O O O 含义 100HZ时钟输入复位信号，高电平有效暂停信号，低电平计数，高电平暂停百分秒高位百分秒低位秒信号高位秒信号低位分钟信号高位分钟信号低位 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. module paobiao( clk, reset, pause, ms_h, ms_l, s_h, s_l, m_h, m_l ); input clk,reset,pause; output[3:0] ms_h,ms_l,s_h,s_l,m_h,m_l; reg[3:0] ms_h,ms_l,s_h,s_l,m_h,m_l; reg flag1,flag2; ......（程序主体部分） ...... endmodule 原理图输入 V