12组合逻辑电路幻灯片.pptVIP

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2017-01-22 发布于浙江
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12组合逻辑电路幻灯片.ppt

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第12章组合逻辑电路第12章组合逻辑电路 12.1 组合逻辑电路的分析和设计12.1.1 组合逻辑电路的分析 12.1.1 组合逻辑电路的分析 12.1.1 组合逻辑电路的分析 12.1.1 组合逻辑电路的分析 12.1.1 组合逻辑电路的分析 12.1.1 组合逻辑电路的分析 12.1.1 组合逻辑电路的分析 12.1.1 组合逻辑电路的分析 12.1.1 组合逻辑电路的分析 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.1.2 组合逻辑电路的设计 12.2 加法器12.2.1 半加器 12.2.1 半加器 12.2.2 全加器 12.2.2 全加器 12.2.2 全加器 12.2.2 全加器 12.2.2 全加器 12.2.2 全加器 12.3 编码器 12.3.1 二进制编码器 1. 4/2线编码器 1. 4/2线编码器 2. 优先编码器 4/2 线优先编码器 12.3.2 二 – 十进制优先编码器 12.3.2 二 – 十进制优先编码器 12.3.2 二 – 十进制优先编码器 12.3.2 二 – 十进制优先编码器 12.3.2 二 – 十进制优先编码器 12.4 译码器和数字显示12.4.1 二进制译码器 74LS138译码器 74LS138译码器 74LS138译码器 74LS138译码器 74LS138 译码器 74LS138 译码器 12.4.2 数字显示译码器 12.4.2 数字显示译码器 12.4.2 数字显示译码器 12.4.2 数字显示译码器 12.4.2 数字显示译码器 12.5 数据分配器和数据选择器 12.5.1 数据选择器 12.5.1 数据选择器 12.5.1 数据选择器 12.5.1 数据选择器 12.5.1 数据选择器 12.5.1 数据选择器 12.5.1 数据选择器 12.5.1 数据选择器 12.5.2 数据分配器 12.5.2 数据分配器 12.5.2 数据分配器 74LS151 功能表使能地址输出 S A0 A2 Y 1 0 0 0 0 0 D3 D2 D1 D0 A2 0 D4 0 D5 0 D6 0 D7 0 0 0 1 0 1 ? ? ? 0 0 0 0 1 1 1 0 0 1 1 0 1 0 1 1 1 1 Y “1” 74LS151 W S D7 D6 D5 D4 D3 D2 D1 D0 W A2 A1 A0 A B C ? CO CI A3 B3 S3 C3 ? CO CI C2 ? CO CI C1 ? CO CI C0 S2 S1 S0 A2 B2 A1 B1 A0 B0 串行进位多位二进制数相加，可采用并行相加、串行进位的方式来完成。缺点：运算速度慢。双极型TTL集成电路T692就属于串行加法器。 ? CO CI S3 C3 ? CO CI C2 ? CO CI C1 ? CO CI C0 S2 S1 S0 1 1 0 1 0 0 1 0 0 1 1 1 1 1 1 1 结果为1101+1101=11010 例6 计算1101+1101 A3 B3 A2 B2 A1 B1 A0 B0 2n 种组合 2n 个信息 2n? N n 位二进制代码编码器 N个信息编码：将二进制数码0和1按一定规律编排起来，用来表示某种信息含义的一串符号。编码器：具有编码功能的逻辑电路。二进制编码器：将输入信号编成二进制代码的电路 1 2 3 0 0 1 0 0 I2 0 0 0 1 I0 输入输出 1 0 0 0 0 1 0 0 Y0 Y1 I3 I1 （b）逻辑真值表任何时刻只允许一个输入是高电平，逻辑为“1”。（a）逻辑框图 4输入二进制码输出 1 1 0 1 1 0 0 0 Y 1 Y 0 I 0 I 1 I 2 I 3 1. 4/2线编码器 I 0 I 1 I 2 I 3 1 1