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嵌入式复习题 2．下列不属于嵌入设计处理器本身带有的基本接口是（）A.串口；B.并口；C. PCIE；D.AD/DA； 3. 以下几个步骤是DMA控制过程的主要节点，请选出正确的DMA控制流程(请求信号HRQ)为（）? (1). CPU让出总线控制权(响应信号HLDA)? (2). DMA控制器向CPU请求总线使用权? (3). DMA控制器控制总线,发总线命令、传送数据? (4). DMA总线控制器归还总线控制权? (5). CPU重新获取总线控制权? A. (2)，(1)，(3)，(4)；???? B. (1)，(2)，(3)，(4)；? C. (3)，(1)，(4)，(2)；???? D. (3)，(4)，(1)，(2)； 6．将系统启动代码读入内存是（）的主要职责A. 内存管理；B. VFS；C. Boot Loader；D. 虚拟内存 11. BSP作为一种嵌入式软件，他的主要特点是（） A. 与硬件无关，与操作系统有关? B. 与硬件和操作系统都相关 C. 与硬件有关，与操作系统无关 D. 与操作系统和硬件都无关 14.下列中断处理过程的步骤，最先执行的是（）A. 安装堆栈? B. 调用中断服务? C. 恢复堆栈? D. 保存寄存器15.嵌入式系统的发展可大概分为四个阶段，其中第三个阶段是（）A. 单片机的嵌入式系统，结构和功能单一，用于工业控制领域。B.实时操作系统的嵌入式系统的嵌入式系统阶段。C. 简单的嵌入式阶段，有较高的可靠性，低功耗的嵌入式处理器和简单的操作系统。D. 面向Internet的阶段。16.下面不是CISC与RISC的架构的差异是（）A. 指令数量不同，前者多，或者较少，通常少于100.B. 前者有些指令执行时间较长，后者则没有。C. 前者有丰富的寻址模式，而后者有较少的寻址模式。D. 前者有复杂的编译器设计，可优化编译技术，生成高效的目标代码程序，而后者则是简单的编译器设计，难以优化生成高效的目标代码程序。 17.下面不是嵌入式ARM架构的嵌入式处理器的特点是（）A. 具有大量的寄存器，指令执行速度快。B. 绝大多数操作都在寄存器中进行，通过Load/Store的体系结构在内存和寄存器之间传递数据。C. 同时支持大端、小端（Big/Little-Endian）数据类型。D. 寻址方式简单，采用固定长度的指令格式。19.下面不是流水线技术的特点是（）A. 指令流水将会终止，如果发生不能顺序执行时。B. 流水线可分成若干相互联系的子过程。C. 实现子过程的功能所需时间尽可能相等。D. 形成流水处理需要一定的准备的时间。23. 早期的可编程逻辑器件不包括下列哪一种 ()A. PROM B. EPROM C. EEPROM D. FPGA 24. 下列哪个是计算机系统中存储速度最慢的存储设备 ()A. CPU内部寄存器 B. 高速缓存(Cache) C. 内存 D. 硬盘 25. 下列哪种存储设备在掉电情况下会丢失数据 ()A. 内存 B. Flash Memory C. CF卡 D. 硬盘30. 下列存储设备中，数据最不容易丢失的是（）A．EPROM? B．DRAM? C．内存? D．SDRAM31.下列哪项不是ARM处理器的特点。()A. 小体积、低功耗B. 可以使用除加载/存储指令外的多种指令访问存储器C. 大多数数据操作在寄存器中完成，执行速度快D. 支持Thumb/ARM双指令集 32. 当加法指令产生进位时，下列哪个条件标志位会发生变化. ()A. C? B. T? C. I? D. F 33.下列哪个不属于ARM处理器的寻址方式. ()A.立即寻址? B.寄存器寻址? C.寄存器间接寻址? D.链表寻址 35.下列哪条指令把寄存器R1、R2的值相加后存到R0中. ()A. AND R0, R1, R2B. SUB R0, R1, R2C. ADD R0, R1, R2D. AND R1, R2, R0 36. R0的中的值为0xFFF3，执行指令AND R0, R0, #3后，R0的值为. ()A. 0x0003? B. 0xFFFF? C. 0xFFF0? D. 0xFFF3 37. CPSR寄存器中Z条件码为0，当前PC值为0xFF00，则执行BEQ 0xAAA0后，PC值为. ( C )A. 0xAAA0? B. 0xAAA4? C. 0xFF04? D. 0xFF00 39. 阅读下列程序，回答问题： LDR R0, 0x22 LDR