基于单片机的等精度频率计设计.docVIP

摘 要 本文主要论述了利用FPGA（Field Programmable Gate Array，现场可编程门阵列）进行测频计数，单片机实施控制实现频率计的设计过程。该频率计利用等精度的设计方法，克服了基于传统测频原理的频率计的测量精度随被测信号频率的下降而降低的缺点。等精度的测量方法不但具有较高的测量精度，而且在整个频率区域保持恒定的测试精度。 设计中用一块FPGA芯片（型号为CycloneⅡ的EP2C5T144C8N）完成各种时序逻辑控制、计数功能。在QuartusⅡ平台上，用VHDL语言编程完成了FPGA的软件设计、编译、调试、仿真和下载。用STC89C52RC单片机作为系统的主控部件，实现整个电路的测试信号控制，数据运算处理和控制数码管的显示输出。系统将单片机的控制灵活性及FPGA芯片的现场可编程性相结合，不但大大缩短了开发研制周期，而且使本系统具有结构紧凑、体积小，可靠性高，测频范围宽、精度高等优点。 文章详细论述了系统自上而下的设计方法及各部分硬件电路组成及单片机、FPGA的软件编程设计。使用杭州康芯KX-7C5T型EDA实验开发与电子设计学习板为主的实验环境下，配合单片机最小系统对软硬件进行仿真和验证，达到了较高的测量精度和测量速度。 关键词：FPGA，VHDL，频率计，单片机，STC89C52RC  目 录 摘 要 I 第一章 概 论 1 1.1课题研究的目的和意义 1 1.2 测量原理 1 1.3 系统设计指标 3 第二章 硬件电路设计 5 2.1 系统顶层电路设计 5 2.2 FPGA测频模块逻辑设计 5 2.3 单片机主控模块 6 2.4 外围电路设计 8 第三章 软件设计 11 3.1 Quartus II概述 11 3.2 VHDL语言简介 12 3.3 频率计FPGA模块的顶层设计 12 3.4 频率计FPGA模块的仿真 14 3.5 单片机的C语言编程 15 第四章 系统测试 17 4.1 测频精度分析 17 4.2实验测试数据 18 第五章 总结 19 致 谢 21 参考文献 23 第一章 概 论 1.1课题研究的目的和意义 测频一直以来都是电子和通讯系统工作的重要手段之一。高精度的测频仪有着广泛的市场前景。以往的测频仪都是在低频段利用测周期的方法、高频段用测频率的方法，其精度往往会随着被测频率的下降而下降。 基于传统测频原理的频率计的测量精度将随被测信号频率的下降而降低，在实用中有较大的局限性，而等精度频率计不但具有较高的测量精度，而且在整个测频区域内保持恒定的测试精度。所以等精度频率计有研究的价值。 1.2 测量原理 等精度测频法：其实现方法可用主控结构图1-1和波形图1-2来说明。 图1-1 等精度频率计主控结构图 图1-2 频率计测控时序 图1-1中的“预置门信号”CL由单片机发出，CL的时间宽度对测频精度几乎没有影响，在此设其宽度为Tpr。BZH和TF模块是两个可控的32位高速计数器，EN为它们的技术允许信号端，高电平有效。 标准频率信号从BZH的时钟输入端BCLK输入，设其频率为Fs；经放大整形后的被测信号从与BZH相似的32位计数器TF的时钟输入端TCLK输入，设其真实频率值为Fxe，被测频率为Fx。测频原理说明如下： 测频开始前，首先发出一个清零信号CLR，使两个计数器和D触发器清零，同时通过信号EN，禁止两个计数器计数。这是一个初始化操作。如果系统启动不能正常清零，可以由外部的按键强制清零。 然后由单片机发出允许测频信号，即令预置门控信号CL为高电平（把图1-1和图1-2结合起来看），这时D触发器要一直等到被测信号的上升沿通过时Q端才被置1（即令START为高电平），与此同时，将同时启动计数器BZH和TF，进入图1-2所示的“计数允许周期”。在此期间，BZH和TF分别对被测信号（频率为Fx）和标准频率信号（Fs=100MHz）同时计数。当Tpr秒后，预置门信号被单片机置为低电平，但此时两个计数器仍没有停止计数，一直等到随后而至的被测信号的上升沿到来时，才通过D触发器将这两个计数器同时关闭。由图1-2可见，CL的宽度和发生的时间都不会影响这样一个事实，计数使能信号（START）允许计数的周期总是恰好等于待测信号TCLK的完整周期数，这正是确保TCLK在任何频率条件下都能保持恒定精度的关键。而且，CL宽度的改变以及随机的出现时间造成的误差最多只有BCLK信号的一个时钟周期，但是BCLK是倍频后的100MHz信号，则任何时刻的绝对测量误差只有亿分之一秒。 被测频率值为Fx，标准频率为Fs，设在一次预置门时间Tpr中对被测信号计数值为Nx，对标准信号的计数值为Ns，则下式成立： Nx / Fx = Ns / F