时序电路的分析与设计.ppt

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时序电路的分析与设计

6.4 寄存器 1. 寄存器和移位寄存器 1) 寄存器 寄存器用于寄存一组二进制代码,它被广泛用于各类数字系统和数字计算机中。因为一个触发器能存储一位二进制代码, 所以用n个触发器组成的寄存器能存储一组n位二进制代码。对寄存器中使用的触发器只要求具有置1、置0的功能即可, 因而无论是用基本RS结构的触发器,还是用数据锁存器、主从结构或边沿触发结构的触发器,都能组成寄存器。 (1) 二拍接收四位数据寄存器 图6-14是由基本RS触发器构成的二拍接收四位数据寄存器。当清0端为逻辑1,接收端为逻辑0时,寄存器保持原状态。 当需将四位二进制数据存入数据寄存器时,需二拍完成:第一拍,发清0信号(一个负向脉冲),使寄存器状态为0(Q3Q2Q1Q0=0000);第二拍,将要保存的数据D3D2D1D0送数据输入端(如D3D2D1D0=1101),再送接收信号(一个正向脉冲),要保存的数据将被保存在数据寄存器中(Q3Q2Q1Q0=1101)。从该数据寄存器的输出端Q3Q2Q1Q0可获得被保存的数据。 图 6-14 二拍接收四位数据寄存器 (2) 单拍接收四位数据寄存器 图6-15是由数据锁存器构成的单拍接收四位数据寄存器。 当接收端为逻辑0时,寄存器保持原状态;当需将四位二进制数据存入数据寄存器时,单拍即能完成——将要保存的数据D3D2D1D0送数据输入端(如D3D2D1D0=1101),再送接收信号(一个正向脉冲),要保存的数据将被保存在数据寄存器中(Q3Q2Q1Q0=1101)。同样从数据寄存器的输出端Q3Q2Q1Q0可获得被保存的数据。 对于功能完善的触发器,如主从JK触发器、维持—阻塞式D触发器等,都可构成这类数据寄存器。 图 6-15 单拍接收四位数据寄存器 2) 移位寄存器 对于串行数据,则采用移位寄存器输入并加以保存。移位寄存器的功能和电路形式较多,按移位方向来分有左向移位寄存器、右向移位寄存器和双向移位寄存器;按接收数据的方式可分串行输入和并行输入;按输出方式可分串行输出和并行输出。  (1) 单向移位寄存器 图6-16所示电路是由维持—阻塞式D触发器组成的四位单向移位(右移)寄存器。在该电路中,Ri为外部串行数据输入(或称右移输入),Ro为外部输出(或称移位输出),输出端Q3Q2Q1Q0为外部并行输出,CP为时钟脉冲输入端(或称移位脉冲输入端,也称位同步脉冲输入端), 清0端信号将使寄存器清0( Q3Q2Q1Q0 =0000)。 在该电路中, 各触发器的激励方程为 或 图 6-16 四位单向移位(右移)寄存器 设输入Ri=1011,则清0后在移位脉冲CP的作用下,移位寄存器中数码移动的情况如表6-6所示,各触发器输出端Q3Q2Q1Q0的波形如图6-17所示。 表 6-6 移存器数码移动状况 图 6-17 移位寄存器工作波形图 (2) 双向移位寄存器 图 6-18 四位双向移位寄存器 图6-18所示电路是由维持—阻塞式D触发器组成的四位双向移位寄存器。在该电路中,Q5为右移串行输入,Q0为左移串行输入,Q1为右移串行输出,Q4为左移串行输出,输出端Q4Q3Q2Q1为并行输出端,CP为移位脉冲输入端,D4D3D2D1为并行数据输入端,M端为工作方式控制端,清0端信号将使寄存器清0( Q4Q3Q2Q1 =0000),接收信号将并行输入数据D4D3D2D1写入到移位寄存器中。 本电路采用二拍接收并行数据的工作方式。 由逻辑电路图可以写出组合电路的输出函数和激励函数。 对于由k级触发器构成的移位寄存器来讲,其激励函数和次态方程分别为 当M=1时, 电路实现右移功能。 当M=0时, 电路实现左移功能。 表 6-9 同步十进制可逆计数器状态表一(有效状态) 续表 图 6-23 同步十进制可逆计数器状态图 图 6-24 可逆计数器M=1时的波形图 表 6-10 同步十进制可逆计数器状态表二(无效状态) 3. 脉冲分配器 图 6-25 脉冲分配器 (a) 逻辑电路图; (b) 状态图; (c) 工作波形图 由电路可写出输出函数和激励函数为 结合JK触发器的特征方程 , 可得新状态方程: 由输出函数和新状态方程可得状态转换表如表6-11,状态转换图和工作波形分别如图6-25(b)、(c)所示。由工作波形图可清楚地看到,电路在时钟脉冲的作用下,按一定顺序

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