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第3章 TMS320LF240x的CPU功能模块和时钟模块 3.1 CPU功能模块 3.2 锁相环(PLL)时钟模块和低功耗模式 作业:7)CPU 的主要功能 8)ARn的作用 9)什么是DARAM、SARAM 10)PLL的作用 3.1 CPU功能模块 CPU是DSP的核心部件,主要进行取数、运算(加、乘、移位等)、送数的操作。包括:输入定标移位器、中央算术逻辑单元(CALU)和乘法单元等。 退出 定标移位器对输入数据进行0-15位左移。 左移时,输出数据的最低有效位(LSB)为0,最高有效位(MSB)根据状态寄存器ST1的符号扩展控制位SXM的值来决定是否需要进行符号扩展。 (1)当SXM=1时,高位进行符号扩展; (2)当SXM=0时,高位填0。 移位次数由包含在指令中的常量或临时寄存器(TREG)中的值来指定。 退出 3.1.1 输入定标移位器 用于完成不同数据格式之间的转换。 因为240x芯片的数据总线是16位,而中央算术逻辑单元(CALU)是32位,必须把16位数据转换为32位,实现数据格式转换。因此,输入定标移位器的16位输入与数据总线相连,32位输出与CALU单元相连。 输入定标移位器作为从数据总线到CALU之间的数据传输路径的一部分,不会额外占用CPU的时钟开销。 数据写 数据读 程序读 16×16位的硬件乘法器,可以在一个机器周期内完成有符号或无符号数的乘法运算,乘积结果为32位。 工作原理: TREG的内容和来自数据存储器或程序存储器中的数相乘,乘积存放到乘积寄存器(PREG) 中(32位)。然后,通过乘积移位器(PSCALE) 将PREG的值在送往CALU或进行移位定标处理送入数据存储器。 退出 3.1.2 乘法器 乘积移位器根据状态寄存器ST1中的PM值的不同,可进行4种不同形式的移位操作。 对乘积结果定标,以使得运行128次的乘积累加而累加器不会溢出 11 当与一个13位的常数相乘时,移去在16X13位(常数)二进制补码产生的4位冗余符号位,产生Q31格式的乘积 10 移去二进制补码乘法产生的冗余符号位,产生Q31格式的乘积 01 乘积送到CALU或数据写总线,不移位 00 作用和意义 PM 移位 不移位 左移1位 左移4位 右移6位 注:移位后,PREG中的值不变。 退出 3.1.2 乘法器 退出 由32位的中央算术逻辑单元(CALU)、32位的累加器(ACC)以及32位的输出移位器组成。 3.1.3 中央算术逻辑单元 (2)溢出方式位(OVM)决定累加器如何处理算术运算的溢出,当OVM=1且有溢出发生时,累加器自动填充最大值或最小值;当OVM=0时,累加器中的结果正常溢出。 (3)当未检测到累加器溢出时,其值为0;当溢出发生时,OV位被置1。 (4)根据被测试位的结果,测试控制标志位(TC)位被置1或0。 退出 注意几个问题: (1)当加到累加器或从累加器减或将累加器数值移1位或循环移1位时将影响进位标志位C。 3.1.3 中央算术逻辑单元 退出 存放CALU中的运算结果,其存放的数据可以执行单一的移位或循环操作。其中的高位或低位字可以进入输出定标移位器进行移位后再存放进数据存储器。与ACC有关的状态位有: 1)进位标志位C ① 当累加器中的数据相加时,结果有进位或减法无借位时C=1;相减时,结果有借位或或加法无进位时,C=0 。 ② 当累加器中的数据被移动1位时,累加器中的最低位或最高位进入C。 3.1.4 累加器(ACC) 2)溢出方式控制位OVM OVM决定ACC运算结果发生溢出时,是否进行溢出处理。 ① 若OVM=1,当运算结果发生溢出时,ACC结果被设定为确定值: 若正向溢出,ACC=7FFF FFFFH(最大正数); 若负向溢出,ACC=8000 0000H(最小负数)。 ② 若OVM=0,ACC溢出为0. 退出 3)溢出标志位OV 当累加器发生溢出时,OV=1,反之为0。 3.1.4 累加器(ACC) 4)测试/控制标志位TC 根据被测试位的值置1,或清0。 与累加器有关的转移指令主要取决于以上标志位状态,及累加器的值。 3.1.5 输出数据定标移位器 根据相应的存储指令中指定的位数,将累加器输出的内容左移0~7位,然后将移位器的高16位或低16位存储到数据RAM中。 注意:累加器中的数据不变 退出 3.1.6 状态寄存器ST0和ST1 状态寄存器ST0和ST1,含有各种状态和控制位。状态寄存器的内容可以被保存到数据寄存器,也可从

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