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QuartusII使用的教程图形输入
* 1、建立波形矢量文件（左图）； 2、添加引脚节点 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 添加引脚节点（续） 在Filter下选择“Pins：unassigned”，再单击“List”，列出引脚端口 ” 在Nodes Found下方的列表下选择所列出的端口，将其拖放到波形文件的引脚编辑区 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 3、设置仿真时间长度 默认为1us，这里将其设置为100us Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 实验七、基于Quartus II的 原理图输入数字电路设计 本部分实验内容为新内容，操作步骤较多，为保证实验项目进行完毕，请同学们务必提前做好预习准备 预习要求 1.从实验中心网站下载软件 2.按照ppt所示，操作使用，仿真数字逻辑器件功能 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 第一部分：实验要求 通过本次实验，引导学生以EDA设计的手段来设计数字逻辑电路； 认识可编程逻辑器件(PLD)； 掌握QuartusII集成开发环境软件。 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 一、实验目的 1. 学习EDA集成工具软件Quartus II的使用； 2. 学会基于PLD的EDA设计流程； 3. 学会使用原理图设计小型数字电路； 4. 掌握对设计进行综合、仿真和设计下载的方法。 二、实验目仪器及器件 1、实验设备：数字电路实验箱1台 2、实验器件：可编程逻辑器件（背板） Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 三、实验原理 可编程逻辑器件（Programmable Logic Devices，PLD），发展于20世纪70年代，属半定制集成电路； 使用PLD器件，借助EDA设计方法，可以方便、快速地构建数字系统； 任何组合逻辑电路都可以用“与门-或门”二级电路实现； 任何时序逻辑电路都可以由组合逻辑电路加上存储元件（触发器、锁存器构成）； 人们由此提出乘积项可编程电路结构，原理结构如下： Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 低密度PLD可编程原理【早期器件】 低密度（简单）PLD，通常内部等效门数少于500个，只能实现通用数字逻辑（如74系列）的一些功能 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. * 使用FPGA（大容量可编程逻辑器件）从事数字系统设计的三阶段： 1、常规逻辑功能描述的实现； 指常规数字逻辑器件，如3-8线译码器74LS138，二进制计数器74LS161，移位寄存器74LS194等； 2、时序产生及控制、小型数字系统的实现； 如用状态机完成AD信号的采集，产生PWM时序控制步进电机 简易数字频率计、交通灯、数字种系统的实现等； 3、算法功能/综合系统的实现 FFT算法实现、频谱分析等。 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0
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