《数字电子技术项目》项目2多数表决器电路设计与制作学案.pptVIP

《数字电子技术项目》项目2多数表决器电路设计与制作学案.ppt

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项目2 多数表决器电路设计与制作 ;2.1 项目描述 ;2.2 项目资讯 ;3.逻辑函数的表示方法;4.逻辑函数表达式 ;3)逻辑函数的最小项表达式;2.2.2公式法化简逻辑函数 ;3.消去法 利用 消去多余因子。 4.配项法 在不能直接运用公式、定律化简时,可通过乘 或 进行配项后再化简。 例如;2.2.3卡诺图法化简逻辑函数 ;3.用卡诺图表示逻辑函数 ;解:这是一个四变量的逻辑函数,首先要画出四变量卡诺图的一般形式,然后在最小项编号为 0,1,4,5,6,9,12, 13 ,15 的小方格内填入1,其余小方格内填入0或空着,即得到了该逻辑函数的卡诺图。;4.用卡诺图化简逻辑函数 ;2)用卡诺图化简逻辑函数的原则;【例题2-7】试用卡诺图化简逻辑函数。 解:(1)画出卡诺图如图2-8所示。 (2)化简卡诺图。化简卡诺图时,一般先圈独立的1方格,再圈仅两个相邻的1方格,再圈仅4个相邻的1方格,依次类推。 (3)合并包围圈的最小项,写出最简与或表达式。 ;5.化简具有无关项的逻辑函数 ;2.2.4组合逻辑门电路 ;2.组合逻辑电路分析;【例2-11】分析图所示的组合逻辑电路。 解:(1)根据逻辑电路写出输出逻辑函数表达式。由图可得 ;由此可得电路的输出逻辑函数表达式为 (2)根据逻辑函数表达式列真值表。;3.组合逻辑电路的设计 ;4.组合逻辑电路中的竞争冒险 ;2.)冒险现象的识别 在输入变量每次只有一个改变状态、其余变量取特定值(0或1)的简单情况下,若组合逻辑电路输出函数表达式为下列形式之一,则存在逻辑险象。 ;3).逻辑险象的消除方法;2.3 技能训练 组合逻辑电路的功能测试 ; 测试电路 2)分析两电路的逻辑功能 a)图的逻辑功能: b)图的逻辑功能:;2.4 项目实施 ;2.4.2 项目制作 ; 电路安装 1)将检测合格的元器件按照图2-19所示电路连接安装在面包板或万能电路板上。 2)插接集成电路时,先校准两排引脚,与底板上插孔对应,然后在确定引脚与插孔吻合后,再稍用力将其插紧。 3)导线应粗细适当,一般选取直径为0.6~0.8mm的单股导线,最好用不同色线以区分不同用途。 4)布线应有次序地进行,随意乱接容易造成漏接或接错,较好的方法是接好固定电平点,其次,按信号源的顺序从输入到输出依次布线。 5)连线应避免过长,避免从集成元件上方跨越,避免多次的重叠交错。 6)电路布线应整齐、美观、牢固。

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