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*;课程基础;课程特点;课程目标;课程基本要求;课程教学内容;课程参考;课程体系结构;“DSP原理与应用”章节安排;*;*;*;*;典型数字信号处理系统;*;*;*;*;*;*;*;*;*;*;*;*;*;*;*;*;GPP的Von.Neumann结构;*;*;*; DSP常用算法中的乘法与累加;算法分析
当用有限N项之和近似代替无穷求和时，DSP常用算法可归纳为：
针对这类N项双操作数相乘后乘积求和的通用形式，DSP中从硬件结构上采用了多种先进技术，最终实现了N项乘积和主运算仅需要N个指令周期。
;*;*;*;*;*;*;*;*;*;*;*;*;*;TMS320VC5509-200
PGE（S-PQFP-G144）;1.4.5 DSP发展趋势;;其它公司的DSP芯片;CPU： 双核ARM? Cortex? A57（最高2GHz）和四核A53内核，支持64位
GPU：Adreno 430 GPU
DSP： Hexagon V56 DSP（最高800MHz）,可让多种应用程序以超低功耗运行，如音乐播放程序、增强的音频效果应用程序、计算机视觉处理应用程序以及静止和视频图像增强应用程序
;DSP应用系统的开发工具;DSP的开发工具;TI公司的开发工具;DSP开发流程;*;
单周期执行时间=1/时钟频率
◎ MIPS(Million Instruction Per Second)
TMS320C5402 $6/100MIPS 60mw
TMS320C5416 $39/160MIPS 90mw
TMS320C55x 0.9v 0.05mw/MIPS 800MHz
◎ MFLOPS(Million Floating Point Operation Second)
TMS320C6701 $210/1GFLOPS
; ◎MBPS(Million Bit Per Second)
(主要用来衡量DSP数据传输能力，是对总线和I/O口
数据吞吐率的度量，也就是总线和I/O口的带宽)
例：‘C6000 200MHz时钟 32--bit总线
则总线数据吞吐率为 800Mbyte/s 或 6400MBPS
◎MACS(Multiply---Accumulates Per Scond)
;*;*;*;*;*;1、数据格式 ;0;浮点数与定点数的转换关系 ;浮点数的表示;Q表示;数据类型;加法/减法运算的C语言定点模拟 ;定点加法 ;例子：
设x＝0.5，y＝3.1，则浮点运算结果为z＝x+y＝0.5+3.1＝3.6;
Qx＝15，Qy＝13，Qz＝13，则定点加法为：
x＝4000H=16384；y＝6333H=25395;
temp＝253952＝101580;
temp＝x+temp＝16384+101580＝117964;
z＝(int)(117964L2)＝29491;
验算：z＝29491/8192??3.6
;定点减法 ;结果超过16位表示范围 ;例子：
设x＝15000，y＝20000，则浮点运算结果为z＝x+y＝15000+20000＝35000，显然z32767;
Qx＝1，Qy＝0，Qz＝0，则定点加法为：
x＝15000*21=30000；y＝2000*20=20000;
temp＝200001＝40000;
temp＝temp+x＝40000+30000＝70000;
z＝70000L1＝35000; ;乘法运算的C语言定点模拟 ;定点乘法 ;除法运算的C语言定点模拟 ;定点除法 ;程序变量的Q值确定 ;2、运算方法 ;定点乘法 ;定点乘法（续）;定点乘法（续）;32位×32位：;32位×32位：;定点乘法 ;定点除法 ;定点除法 ;定点除法 ;定点除法 ;定点除法 ;定点除法 ;*;*;*
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