D触发器设计的74LS164移位寄存器.docVIP

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2017-05-10 发布于浙江
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D触发器设计的74LS164移位寄存器.doc

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D触发器设计的74LS164移位寄存器

底层D触发器的设计： LIBRARY IEEE ; USE IEEE.STD_LOGIC_1164.ALL ; ENTITY D_FF IS PORT ( D , CLK : IN STD_LOGIC ; Q : OUT STD_LOGIC ) ; END ENTITY D_FF ; ARCHITECTURE ONE OF D_FF IS SIGNAL QTEMP : STD_LOGIC := 0 ; BEGIN PROCESS ( CLK , D ) BEGIN IF CLKEVENT AND CLK = 1 THEN QTEMP = D ; END IF ; END PROCESS ; Q = QTEMP ; END ARCHITECTURE ONE ; 高层74164移位寄存器的设计： LIBRARY IEEE ; USE IEEE.STD_LOGIC_1164.ALL ; ENTITY D74164 IS PORT ( A , B , CLK , CLR : IN STD_LOGIC ; Q : OUT STD_LOGIC_VECTOR ( 7 DOWNTO 0 ) ) ; END ENTITY D74164 ; ARCHITECTURE ONE OF D74164 IS COMPONENT D_FF IS PORT ( D , CLK : IN STD_LOGIC ; Q : OUT STD_LOGIC ) ; END COMPONENT ; SIGNAL S : STD_LOGIC_VECTOR ( 8 DOWNTO 0 ) ; BEGIN S ( 0 ) = A AND B ; D_FFX : FOR INUM IN 0 TO 7 GENERATE BEGIN U1 : D_FF PORT MAP ( D = S ( INUM ) , CLK = CLK , Q = S ( INUM + 1 ) ) ; END GENERATE D_FFX ; Q = ZZZZZZZZ WHEN CLR = 1 ELSE S ( 8 DOWNTO 1 ) WHEN CLR = 0 ; END ARCHITECTURE ONE ;