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2017-05-20 发布于浙江
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ch5 时序逻辑电路-1

* 【例1】分析图示电路的逻辑功能，要求步骤完整分析结果：该电路为同步五进制递增（加1）计数器，能够自启动 * 【例2】分析图示电路的逻辑功能解： (1) 根据电路图写驱动方程 (2) 画状态转换表 * 0 0 0 0 0 0 0 1 1 0 0 1 0 0 1 0 0 1 1 1 1 0 1 0 0 1 0 0 0 0 0 1 1 0 1 1 0 1 1 1 1 1 1 1 1 1 0 0 1 0 0 0 0 0 0 1 1 1 0 1 1 0 1 0 0 1 1 1 1 1 1 0 1 1 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 0 0 状态转换表 * (3) 画状态转换图由状态转换图可知，该电路为同步八进制递增（加1）计数器画波形图（略） * 【例3】分析图示电路的逻辑功能，设各触发器的初始状态为0 解： (1) 根据电路图写驱动方程 (2) 画状态转换表 * 0 0 0 0 0 1 0 0 1 0 0 1 0 1 1 0 1 1 0 1 0 1 0 0 1 0 0 0 1 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1 0 1 0 1 0 0 1 0 1 1 0 1 0 0 1 0 0 1 1 1 1 1 0 1 1 0 状态转换表 * (3) 画状态转换图由状态转换图可知，该电路为同步六进制计数器，能够自启动（能自启动的扭环形/约翰逊计数器）画波形图（六分频） * 二、同步计数器的设计任务：根据所给用文字等描述的逻辑功能，找出实现该功能的逻辑电路。【例4】用上升沿触发的D触发器设计一个六进制扭环型计数器【解】（1）根据文字描述的逻辑功能，确定触发器类型与个数，列出状态转换表、激励表。（2）求出各触发器的激励方程（3）检查自启动，画逻辑电路图，并画时序波形图 * 【例5】用下降沿触发的JK触发器设计一个8421BCD码的加1计数器【解】（1）根据文字描述的逻辑功能，确定触发器类型与个数，列出状态转换表、激励表。 8421BCD码为4位二进制码，故要用4个JK触发器， FF3 FF2 FF1 FF0，其状态为Q3Q2Q1Q0 状态转换表见下页 * 0 0 0 0 0 0 0 1 0 × 0 × 0 × 1 × 0 0 0 1 0 0 1 0 0 × 0 × 1 × × 1 0 0 1 0 0 0 1 1 0 × 0 × × 0 1 × 0 0 1 1 0 1 0 0 0 × 1 × × 1 × 1 0 1 0 0 0 1 0 1 0 × × 0 0 × 1 × 0 1 0 1 0 1 1 0 0 × × 0 1 × × 1 0 1 1 0 0 1 1 1 0 × × 0 × 0 1 × 0 1 1 1 1 0 0 0 1 × × 1 × 1 × 1 1 0 0 0 1 0 0 1 × 0 0 × 0 × 1 × 1 0 0 1 0 0 0 0 × 1 0 × 0 × × 1 1 0 1 0 × × × × × × × × × × × × 1 0 1 1 × × × × × × × × × × × × 1 1 0 0 × × × × × × × × × × × × 1 1 0 1 × × × × × × × × × × × × 1 1 1 0 × × × × × × × × × × × × 1 1 1 1 × × × × × × × × × × × × * （2）求出各触发器的激励方程 * （3）画逻辑电路图，检查自启动，并画波形图 * 检查自启动 1 0 1 0 0 0 0 0 0 0 1 1 1 0 1 1 1 0 1 1 0 1 1 1 0 1 1 1 0 1 0 0 1 1 0 0 0 0 0 0 0 0 1 1 1 1 0 1 1 1 0 1 0 1 0 0 0 1 1 1 0 1 0 0 1 1 1 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 0 0 0 0 * 由状态转换图可知，该电路可以自启动。（4）画出时序波形图（略） * 5.6.3 中规模集成计数器 1. 异步清零四位二进制计数器（74161） EP,ET—功能控制输入，PE—同步预置控制（低电平有效）， cp—时钟，CR—异步清零（低电平有效），TC—