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- 2017-06-03 发布于湖北
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第三章 组合逻辑电路
本章以逻辑代数为数学工具,从逻辑门构成的组合逻辑电路入手,介绍分析和设计组合逻辑电路的基本方法,并讨论组合逻辑电路中的竞争冒险现象,为进一步学习带记忆功能的电路奠定基础。同时重点讨论若干常用中规模集成电路模块及其应用,利用VHDL语言实现数字电路的描述及设计。
第一节 基本知识、重点与难点
一、基本知识
(一)组合电路的分析与设计
1.组合电路基本概念
任一时刻的输出状态只取决于该时刻各输入状态的组合,与电路的原状态无关。电路只有从输入到输出的通路,没有从输出到输入的反馈回路。电路由逻辑门构成,不含记忆元件。
2.组合电路分析
用逻辑函数描述已知的电路,找出输入、≥m。常用的编码器有二进制编码器、优先编码器和二—十进制编码器等。
2.译码器
译码器将二进制代码翻译成具有特定含义的输出信号。常用的译码器有二进制译码器、二—十进制译码器和数字显示译码器等。常用的有3线-8线译码器74138、4线-10线8421BCD译码器7442等。
3.数据选择器
数据选择器根据地址选择信号从多路输入数据中选择一路送到输出端。数据选择器可等效成一个单刀多掷开关。常用的有4选1数据选择器74153、8选1数据选择器74151。
4.数值比较器
数值比较器可以对两个位数相同的二进制整数进行数值比较,判定其大小。常用的有4位二进制数值比较器7485。
5.加法器
实现二进制数加法运算
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