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简写VHDL程序的方法
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简写VHDL 程序的方法
蔡连峰
VHDL 语言语法比较简单,但是写VHDL 程序时,人们往往抱怨代码太长,我在使用
VHDL 的过程中发现,如果使用适当的描述语句,也可以将VHDL 程序写得比较简洁。本
文描述了几种简写VHDL 程序的语句,供大家在写程序的过程中参考。
1 使用组合逻辑
对于一些描述逻辑功能的电路,如果在程序中适当地应用组合逻辑描述替代功能描述,
可
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