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通信工程实验报告班级： 姓名：学号： 实验一BDPSK 调制解调器设计 一、实验目的掌握 BDPSK 的调制和解调原理。掌握倍频和分频的概念以及分频的实现方法。用 VerilogHDL 硬件描述语言建模，实现 BDPSK 基带调制解调系统。二、实验说明由于在 BPSK 解调中，相干载波恢复时可能出现相位模糊，所以在实际应用中经常采用 BDPSK（二进制差分相移键控）方式。BDPSK 方式不需要在解调端恢复相干参考信号，非相干接收机容易制造而且成本低，因此在无线通信系统中被广泛使用。 1.BDPSK 基带调制系统结构在 BDPSK 调制系统中，输入的二进制序列先进行差分编码，然后再用 BPSK 调制器调制。一个基带的 BDPSK 调制系统如图 1 所示。2.差分编码差分编码原理为：设计一个模二加法器和一个延迟单元，将当前时钟周期的绝对码信号和上一时钟周期经过一个码元延时的相对码信号进行模二加法（异或），得到当前时钟周期的相对码，并反复进行。延迟单元的功能可以用硬件电路中的寄存器来实现，用它作为保存上一次生成的相对码的容器，然后在下个时序到来时与当前的绝对码进行模二加得到输出。图 2 差分编码原理三、实验结果1.调制系统中各子模块的 VerilogHDL 代码及注释。差分编码：module Chafen(dataPN, clk1, reset_n, dataCF);input