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数字电技术自测练习第5 章
数 字 电 子 技 术 自 测 练 习
第 5 章 时序逻辑电路
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数字电子技术 第 5 章 时序逻辑电路 单项选择题
1、时序逻辑电路在结构上 ( ) 。
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根据时序逻辑电路任一时刻的输出信号,不仅取决于该时刻的输入信号,还与输入信号作用前电路所处的状态有关的功能特点,在结构上必须有存储电路记忆电路以前所处的状态。
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数字电子技术 第 5 章 时序逻辑电路 单项选择题
2、同步时序逻辑电路和异步时序逻辑电路的区别在于异步时序逻辑
电路 ( ) 。
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异步时序逻辑电路在结构上,各触发器的时钟端不接到同一个时钟信号上,没有统一的时钟脉冲控制,状态变化时不和时钟脉冲同步 。
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数字电子技术 第 5 章 时序逻辑电路 单项选择题
3、图示各逻辑电路中,为一位二进制计数器的是 ( ) 。
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数字电子技术 第 5 章 时序逻辑电路 单项选择题
4、从0开始计数的N进制增量计数器,最后一个计数状态为 ( ) 。
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从0开始计数的N进制增量计数器,其计数状态依次是0、1、2、…、 N-1 ,共 N 个计数状态。
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数字电子技术 第 5 章 时序逻辑电路 单项选择题
5、由 n 个触发器构成的计数器,最多计数个数为 ( ) 。
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每个触发器 Q 端有 0、1 两种可能状态, n 个触发器有 2n 种可能的状态,最多计数个数为 2n 个 。
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数字电子技术 第 5 章 时序逻辑电路 单项选择题
6、若构成一个十二进制计数器,所用触发器至少 ( ) 。
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进制数 N = 12,设触发器的个数为n,按 N ≤2n 关系计算n ,并取最小整数, n = 4。
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数字电子技术 第 5 章 时序逻辑电路 单项选择题
7、 3位移位寄存器组成的环形计数器,其进制数为 ( ) 。
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n 位环形计数器,由 n 个触发器构成,有效状态数 = n 。
计数器的进制数 = 有效状态数 。
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数字电子技术 第 5
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