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EDA (VHDL FPGA) 实验指导教程 编者 林海波 长春工程学院电子信息教研室 EDA(VHDL FPGA)实验指导教程 前 言 本实验指导教程是EDA （VHDL FPGA ）上机实验指导教材， 上机实验前，学生应依照教师指定的实验项目，认真预习实验内容， 提前确定实验方案、初步设计实验项目的逻辑电路图或编写、设计 VHDL 程序，编制VHDL 程序清单。上机实验是一个验证和调试过程， 只有充分的预习才能最大的发挥学习效果。 学生在实验教学中要认真依据要求完成每个实验项目，并按照要 求详细撰写本书中指定实验项目的实验报告。 教师批阅后，将报告发回。学生所获得的成绩将作为平时上机实 验成绩的一部分，记入期末的考核成绩。在期末必须上交全部实验报 告，并装订存档，不及时交回者，实验成绩记为零分。 本实验指导教程可以作为《VHDL 与数字系统设计》课程的实验 指导书使用，也可以作为《EDA （VHDL ）课程设计》的参考书使用。 《VHDL 与数字系统设计》课程组 2009 年5 月 １ EDA(VHDL FPGA)实验指导教程 第一章 MAX+PLUS ⅡEDA 软件操作 第一节 逻辑设计的输入方法 逻辑设计的输入方法有图形输入、文本输入等。输入方法不同，生成的文件格式也有所 不同。我们分别以图形输入法和文本输入法介绍MAX+plus II 软件的使用方法。 1.1 图形设计输入法 我们将用一简单的实例介绍该输入法。启动MAX+plus II，该管理器窗口被打开。 1. 项目的建立 用户的每个独立设计都对应一个项目，每个项目可包含一个或多个设计文件，其中有 一个是顶层文件，顶层文件的名字必须与项目名相同。编译器时对项目中的顶层文件进行 编译，所以必须确定一个文件作为当前项目。对于每个新的项目应该建立一个单独的子目 录，当指定项目名称时，也就同时指定了保存该设计项目的子目录名。建立项目名称的步 骤如下： 1．在File 菜单中选择Project 的Name 项（图1.1），将出现图1.2 对画框。 图1.1 键入项目名 如：cntm12 改变路径 改变盘符，如： E:\mydesign\graph 图1.2 2 ．在Project Name 框内，键入设计项目名（注意：一定是英文名）和所选的路径，单击 OK 。这时，MAX+plus II 的标题条将显示新项目名字。 2．建立新的图形文件 ２ EDA(VHDL FPGA)实验指导教程 在File 菜单下选择“NEW ”，出现图1.3 所示的对话窗：