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- 2017-07-23 发布于河南
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EDA工具软件使用初步与硬件描述语言入门
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ENTITY mux21a IS
PORT( a, b : IN BIT ;
s : IN BIT;
y : OUT BIT ) ;
END ENTITY mux21a ;
ARCHITECTURE one OF mux21a IS
BEGIN
y = a WHEN s = 0 ELSE
b ;
END ARCHITECTURE one ;;2选1多路选择器的VHDL描述;2选1多路选择器的VHDL描述;2选1多路选择器的VHDL描述;VHDL相关语句说明;VHDL相关语句说明;VHDL相关语句说明;VHDL相关语句说明;顺序条件语句IF语句;8线-3线优先编码器真值表
输 入 输 出
din0 din1 din2 din3 d
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