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logic synthesis and optimization benchmarks user guide version 3.0(逻辑综合和优化基准用户指南3.0版)
Logic Synthesis and Optimization Benchmarks User Guide
Version
Saeyang Yang 1
This rep ort is issued to provide do cumentation for the b enchmark examples used in conjunction
with the MCNC International Workshop on Logic Synthesis and the extention of the
Logic Synthesis and Optimization Benchmarks User Guide Its distribution is limited to p eer
communication and to participants of the workshop
This rep ort contains material previously published and distributed by the University of Cali
fornia Copyright Regents of the University of California and Stanford
University
For information ab out the ideas expressed herein contact the authors directly For information
ab out the MCNC Technical Rep ort Series or Industrial Aliates Program contact Corp orate
Communications MCNC PO Box Research Triangle Park NC
January
1 Micro electronics Center of North Carolina P O Box Research Triangle Park NC
Contents
Acknowledgements
Benchmark Distribution
Benchmark Examples Included in v Release
FSM Examples : : : : : : : : : : : : : : : : : : : : : : : : : : : : : : : : : : : :
Sequential MultiLevel Examples : : : : : : : : : : : : : : : : : : : : : : : : : : :
Combinational MultiLevel Examples : : : : : : : : : : : : : : : : : : : : : : : : :
TwoLevel Examples : : : : : : : : : : : : : : : : : : : : : : : : : : : : : : : : :
Data Formats for Benchmark Examples
FSM Format : :
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