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数字系统设计和verilog HDL 第6章
第6章 Verilog HDL语法与要素; 主要内容;6.1 Verilog语言要素;空白符和注释 ;标识符（Identifiers）;关键字（Keywords）;◆ 整数
◆ 实数
◆ 字符串;整数按如下方式书写：
+/-size basevalue
即 +/-位宽进制数字
size 为对应二进制数的宽度；base为进制；value是基于进制的数字序列。
进制有如下4种表示形式：
◆ 二进制（b或B）
◆ 十进制（d或D或缺省）
◆ 十六进制（h或H）
◆ 八进制（o或O）;Examples:;实数（Real）有下面两种表示法。
◆ 十进制表示法。例如：
2.0
0.1 //以上2例是合法的实数表示形式
2. //非法：小数点两侧都必须有数字
◆ 科学计数法。例如：
43_5.1e2 //其值为43510.0
9.6E2 //960.0 (e与E相同)
5E-4 //0.0005;字符串（Strings）;6.3 数据类型 ;数据类型 (Data Type);net型;;Variable型;;6.4 参数(parameter);6.5 向量 ;2．位选择和域选择
在表达式中可任意选中向量中的一位或相邻几位，分别称为位选择和域选择，例如：
A=mybyte[6]; //位选择
B=mybyte[5:2]; //域选择
再比如：
reg[7:0] a,b; reg[3:0] c; reg d;
d=a[7]b[7]; //位选择
c=a[7:4]+b[3:0]; //域选择;6.6 运算符 ;;;;;;;;;;运算符 （Operators）;习 题
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