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2017-07-28 发布于河南
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有限状态机设计和化简(第5节).ppt

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有限状态机设计和化简(第5节)

通用有限状态机设计过程;自动售货机FSM;例：简单的自动售货机;例：简单的自动售货机;当前状态输入次态输出t Q1 Q0 D N N1 N0 open 0 0 0 0 0 0 0 0 1 0 1 0 1 0 1 0 0 1 1 – – – 0 1 0 0 0 1 0 0 1 1 0 0 1 0 1 1 0 1 1 – – – 1 0 0 0 1 0 0 0 1 1 1 0 1 0 1 1 0 1 1 – – – 1 1 – – 1 1 1;D1 = Q1 + D + Q0 N D0 = Q0’ N + Q0 N’ + Q1 N + Q1 D OPEN = Q1 Q0;简单的自动售货机(verilog);有限输入串的识别器;有限输入串的识别器;有限输入串的识别器;有限输入串的识别器;有限输入串的识别器;有限输入串的识别器（测试程序）;设计要求：有限输入串的识别器一个输入端 (X) 和一个输出端 (Z)，只要在输入端检测到10010的输入序列，输出端即???1.;always @(state or X) case (state) S0: if (X) next_state = S1 ;else next_state = S0; S1: if (X) next_state = S1; else next_state = S2; S2: if (X) next_state = S1 ;else next_state = S3; S3: if (X) next_state = S4 ;else next_state = S0; S4: if (X) next_state = S1 ;else next_state = S5; S5: if (X) next_state = S1 ;else next_state = S3; default next_state = S0; endcase endmodule;4比特序列检查器;状态简化的等价状态;状态化简方法;行匹配算法概述;状态表和行匹配法;行匹配法;行匹配法迭代;行匹配法化简得到的状态图;蕴含表方法;蕴含表方法;蕴含表方法化简实例;;用蕴含表化简;输入次态输出序列当前状态 X=0 X=1 X=0 X=1 Reset S0 S1 S2 0 0 0 S1 S3 S4 0 0 1 S2 S5 S6 0 0 00 S3 S0 S0 0 0 01 S4 S0 S0 1 0 10 S5 S0 S0 0 0 11 S6 S0 S0 1 0;蕴含表方法化简实例;符号状态转换表 ;minimized state table (S0==S4) (S3==S5);状态分配;状态分配策略;顺序编码;单点编码;随机编码;面向输出的编码;启发式方法;最少位变化启发式方法;I Q Q+ Oi a c ji b c k;例1：3比特序列检测器，当检测到010或110时输出为1;4比特序列检查器;4比特序列检查器;指导原则的有效性