LTE标准下Turbo码编译码器的集成设计 The integrated design of Turbo encoder and decoder in LTE.pdfVIP

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2017-08-12 发布于上海
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LTE标准下Turbo码编译码器的集成设计 The integrated design of Turbo encoder and decoder in LTE.pdf

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LTE标准下Turbo码编译码器的集成设计 The integrated design of Turbo encoder and decoder in LTE

朱铁林1，赵仲元2 (1．哈尔滨工程大学信息与通信工程学院，黑龙江哈尔滨150001； 2．哈尔滨工业大学电子与信息工程学院，黑龙江哈尔滨150001) 译码性能和系统时延。方案采用“自顶向下”的设计思想和“自底而上”的实现方法，对Turbo编译码系 III系列的统模块化设计后优化统一，经时序仿真验证后下载配置到Altera公司Strafix EP3SLl50F1 LTE标准下TurbO码ASIC的开发提供了参考。关键词：Turbo码；FPGA；LTE 中图分类号：TN764 文献标识码：A 文章编号：0258—7998(2010)07—0031—04 The ofTurboencoderanddecoderinLTE design integrated ZHUTie Yuan2 Linl，ZHAO Zhong ofInformationandCommunications 150001，China； (1．College Engineering，HarbinEngineeringUniversity，Harbin 2．Sch001ofElectronicsinformation Instituteof 150001，China) Engineering，HarbinTechnology，Harbin the offixedframe Turbo FPGA ofTurboencoderanddecoder Abstract：For codes，an pooradaptability length implementation whoseframe canbe is inLTE．The is ableto its tothe length configuredproposed design adjustinterleavingdepthaccording environment ofdata thatthe and achievethebest channel andthe request rate，SO decodingperformancesystemdelay and methodis Turboeneoderanddecoderare ”top—down”designthinkingthe”bottom-up”implementationadopted．The optimal ofAltera’SStratixIII unifiedaftermodular meansof simulation，theis toEP3SLl50F1152C2N design．By timing designconfigured results is stableand has a showthatthe family．Test systemrunning