JFET Biasing configurations Fixed biasing Self （JFET偏压配置固定偏压的自我）.pdfVIP

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2017-08-06 发布于浙江
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JFET Biasing configurations Fixed biasing Self （JFET偏压配置固定偏压的自我）

Chapter7. FET Biasing  JFET Biasing configurations Fixed biasing Self biasing Common Gate Voltage divider  MOSFET Biasing configurations Depletion-type Enhancement-type FET Biasing JFET: Fixed Biasing Example 7.1: As shown in the figure, it is the fixed biasing configuration of n-channel JFET. Determine: V , I , V , V , V and V . GSQ DQ DS D G S Solution: Mathematical approach V = - V = - 2V. GSQ GG FET Biasing  V 2  2V 2 I DQ I DSS 1 GS  10mA1   V   8V   P  = 5.625mA V = V – I DS DD D R D = 16V - (5.625mA) (2k) = 4.75V V = V = 4.75V D DS V = V = - 2V G GS V = 0V S FET Biasing  Graphical approach First, according to Shockley ’s equation, we can sketch out the transfer curve. It is known that I = 10mA and V = -8V. DSS P Three points are sufficient to plot the curve. (0 , IDSS) (0, 10mA) (V , 0) (-8V, 0) P (V /2, I /4) (-4V, 2.5mA) P DSS FET Biasing The fixed level of VGS has been superimposed as a vertical line at V = - V = -2V. GS GG The intersection of the two curves is the solution to the configuration, referred to as the quiescent or