带宽稳定的低压锁相环 low voltage phase-locked loop with stabilized bandwidth.pdfVIP

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2017-08-13 发布于上海
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带宽稳定的低压锁相环 low voltage phase-locked loop with stabilized bandwidth.pdf

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带宽稳定的低压锁相环 low voltage phase-locked loop with stabilized bandwidth

and oflC咿j|■I 集成电路ign设andIX-velo砧-nt ngis-XItfo发开一与eve计D doi：10．3969／j．issn．1003—353x．2010．12．016 带宽稳定的低压锁相环杨东a，李冬梅b (清华大学a．微电子研究所；b．电子工程系，北京100084) 摘要：基于UMC0．18肚m混合信号工艺，设计实现了一种具有稳定带宽的低压低功耗电荷泵型锁相环电路，参考频率32．768kHz，输出频率范围l～50MHz，主要为音频A／D提供采样时钟。分析了锁相环环路带宽，给出了一种稳定环路带宽的简易方法。采用低电源电压1V，克服了低压设计的一些难点。仿真结果表明，输出频率24．576MHz(512倍48kHz采样)时，压控振荡器(vco)相位噪声为一109dBc／Hz@lMHz补偿，总功耗180“W。初步测试结果显示，系统输出正确的频率范围。关键词：锁相环；稳定带宽；低压；低功耗；采样时钟中图分类号：TN432文献标识码：A Low Phase-LockedwithStabilizedBandwidth Voltage Loop YangDon98，LiDongmeib Electronic 100084，China) (口．Institute．ofMicroelectronics；b．Departmentof Engineering，孙inghu,aUniversity，Belling Abstract：Alow witha stabilizedbandwidthWas voltage，lowcharge power pumpphase·lockedloop ontheUMC mixed is32．768kHz based CMOS reference designed 0．18／zm signal technology．Thefrequency andthe isfrom1 MHzto50MHz．ItCallbeusedasa clockforaudio outputfrequency sample analog—digital converters．TheofPLLbandwidthwas anda methodforbandwidthstabilizewas theory analyzedeasy proposed． Thecircuit is 1 V，thisworkovercomessomedifficultiesinlow only powerdesign．The powersupply VCO noise dBc／Hzat1 MHz the simulationshowsth