2 DSP的硬件结构的.ppt

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2017-08-19 发布于浙江
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2 DSP的硬件结构的

DSP的硬件结构;1.DSP的硬件结构;Von Neumann结构与Harvard结构;Harvard结构;2.流水线操作（pipeline operation）;3.独立的硬件乘法器;4.独立的DMA总线和控制器;5.CPU;TMS320C2xx的CPU（部分）;TMS320C2xx的硬件乘法器;TMS320C2xx的中央算术逻辑单元（CALU）;P20类似;移位;溢出;6.数据地址发生器（DAG）;Central Processing Unit（CPU）总结;TMS320C2xx的片内存储器及总线;7.外设（peripherals）;TMS320C54x? 系列，定点高性能、低功耗 DSP;ADSP 2100系列DSP结构图;Motorola DSP56002结构图;8.定点DSP与浮点DSP;9.多处理器接口;Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd.;10.DSP的发展方向;第一章概述;高性能静态 CMOS 技术 - 25ns 指令周期 (40 MHz) - 40MIPS性能指标 - 低电压设计：3.3V;片上存储器 - 最高 32K字 Flash EEPROM(分4部分)或ROM - 最高 2.5 K 字的数据/程序存储器 RAM -544 字双口RAM（ Dual-Access RAM） -多达 2K字的单口RAM（ Single –Access RAM） - 片上Flash/ROM程序可加密;具有两个事件管理器(EV) 模块(EVA和EVB)，每个模块包括: -两个16位通用定时器 -八个16位 PWM 通道可以实现下列功能: -三相逆变器控制 -中心或边沿对齐 PWM 波 -引脚( )触发紧急关闭 PWM 通道;PWM原理;PWM原理;SPWM原理;SPWM原理;SPWM原理;;外部存储器接口（LF2407A) -可扩展总共192K 字：64K字程序存储器空间, 64K字数据存储器空间, 64K字I/O寻址空间看门狗定时器模块 10位精度AD转换器 -8或16多路复用输入通道 -375ns或500ns最小转换时间 -可由两个EV来顺序触发两个8通道的ADC;;电源管理: -三种低功耗模式 -可单独将每个外设转入低功耗模式实时JTAG (Join Test Action Group) -兼容边界扫描的模拟器， IEEE 1149.1(JTAG)标准;2407A DSP控制器的功能框图;P5;Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd.;Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd.;Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd.;Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd.;Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd.;Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd.;Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd.;2407A DSP控制器的存储器映射图;