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cpld的串口电路设计
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TOOLSANDSKILLS
CPLD的串口电路设计
●●酶
作者/刘磊,顾斌,龚美霞/南京信息职业技术学院电子信息学院
reset:IN
STD—LOGIC;一一复位信号
rxd:IN
STD—LOGIC;一一串行接收
txd:OUT
本文选用CPLD是ALTERA公司的EPM240T100, STD—LOGIC;一一串行发送
):
结合MAX232接13芯片进行串13通信设计.框图如
END
uart;
下图1所示。
ARCHITECTUREbehavofuartIS
BEGIN
rxds=rxd;
61 62 63 64 5。5152 PROCESS(f10MHz.reset)
EP4M7:4。4T8,。。49 一一设置波特率发生器19200kb/s
VARIABLEclkl9200hz:STD
LOGIC:
VARIABLEcount:lNTEGERRANGE0TO260:
BEGIN
串行口 IFreset=‘0‘THEN
count:=O:
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