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六进制计数器  LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; USE IEEE.STD_LOGIC_ARITH.ALL; ARCHITECTURE rtl OF cnt6 IS SIGNAL q:STD_LOGIC_VECTOR(2 DOWNTO 0); BEGIN PROCESS(clk) VARIABLE q6:INTEGER; BEGIN IF(clk’EVENT AND clk=‘1’) THEN IF(clr=‘0’) THEN q6:=‘0’; ELSIF(en=‘1’) THEN IF(q6=5) THEN q6:=0; ELSE q6:=q6+1; END IF; END IF; END IF; q=CONV_STD_LOGIC_VECTOR(q6,3) qa=q(0); qb=q(1); qc=q(2); END PROCESS; END rtl; 2. 构造体的结构描述方式 所谓构造体的结构描述方式，就是在多层次的设计中，高层次的设计模块调用低层次的设计模块，或者直接用电路设计单元来构成一个复杂的逻辑电路的描述方式.。 ENTITY mux2 IS PORT(d0,d1,sel:IN BIN; q:OUT BIT); 例： 1 U1 d1 sel d0 U3 U2 nsel ab aa q END mux2 * * 例：试设计一个逻辑电路，X=xn-1xn-2…x1x0是该电路得串行输入信号，Z为它的输出，表示X中包含的1个数。 含1统计电路 统计结果 输入序列X 对于这样一个看似十分简单的逻辑电路，却难以用状态表对它进行描述，对于这样一个n位的串行输入序列，将有2n种不同的组合，显然不能按当前已收到的序列来规定电路的状态。如果这样规定，则需要2n个状态；显然也不能按当前序列中已包含1的个数来规定状态，如果这样，则需要n+1个状态，状态表也将十分庞大。 5-3 硬件描述语言VHDL 即： 分析： 由电路功能直接导出状态表的方法并非对所有的电路设计都是适用的，但如果从为实现上述功能必须完成的操作出发，问题就可能很容易解决。 由此可见： (1) 该电路为统计序列中含有的“1”的个数，必须包含有一个加1计数器。 (2) 仅当输入信号为1时才进行加1计数，所以必须还应有判别操作，要做的工作就是设计判别电路和计数器，并配置相应的控制电路使它们能协调地工作，以完成预定的功能。 开始 Z 0 n 0 n n+1 x=1? n=N? Z Z+1 N Y N Y 算法设计的思想：是把系统应实现的逻辑功能看作是应完成的某种运算或操作，若这一运算或操作十分复杂，则可以把它分解成若干个子运算或子操作系统的算法描述的特征。 (1) 含有若干个子运算，实现对数据或信息的存储传输或处理。 (2) 具有相应的控制程序，控制各子运算的执行顺序。 在导出算法流图后，便可将电路划分成数据处理单元和控制单元。 控制器 计A 计B Z CP CR CR C1 C2 X n=N? 结束 ﹥ ﹥ ﹥ 硬件描述语言VHDL概述: 随着超大规模集成电路工艺的发展，待设计电路的规模越来越大，传统的手工艺已无发适应设计复杂数字系统的要求。然而超大规模集成电路的发展也推动了计算机技术和数字技术的发展，使人们有可能开发出功能强大的电子设计自动化(简称EDA)软件，从而改变了人们的设计思想和设计方法，实现设计自动化。 数字系统设计历来存在两个分支，即：系统硬件设计和系统软件设计，但是随着计算机技术的发展和硬件描述语言HDL的出现，使这种情况又有新的变化，数字系统的硬件结构及其行为完全可以用HDL语言来描述和生成，这样即使是软件设计人员也同样可以方便的借助HDL语言，设计出符合要求的硬件系统。 另外也为数字系统的硬件