多cpu并行通信中双口ram的仲裁策略研究与应用 two-port ram arbiter straegies in the parallel data communication between mutiple cpus.pdfVIP

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2017-11-02 发布于上海
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多cpu并行通信中双口ram的仲裁策略研究与应用 two-port ram arbiter straegies in the parallel data communication between mutiple cpus.pdf

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多cpu并行通信中双口ram的仲裁策略研究与应用 two-port ram arbiter straegies in the parallel data communication between mutiple cpus

0O 计算机应用《自动化技术与应用》2 7年第26卷第7期 ComputerApplicatiOns P A 多CU并行通信中双口RM的仲裁策略研究与应用陈志凤 (廊坊师范学院信息工程学院，河北廊坊，065000) 摘要：本文研究了多CPu并行通信双口RAM的仲裁策略，深入分析和比较了硬件仲裁、中断仲裁、令牌仲裁的实现方法和特点，并比较了不同仲裁机制的应用场合。关键字：多CPU；双口RAM；仲裁策略 03 中图分类号：TP274．2文献标识码：B 文章编号：1003—7241(2007)07—0040 RAMArbIter inthePara¨eIData TWO—POrt StraegieS COmmuniCatiOnbet＼／＼／eenM CPUS ulIpIe CHEN Zhi—feng of Teacherts 065000 Electrc商csand (Sch001 hl：foⅡn撕衄，LangF缸g UIliVers时hallg—FaIlgChiIla) Abstract：Thisstudiesthe RAMarbiter inthe datacommunicationbetween paper two-port strategyparallel multiple discussedand inthe arbiterssuchashardware arbiterandtokenarbiterare arbiter，interlllpt comparedpaper． Keywords：Multi—CPU；Two—PonRAM；arbiterstrategy 1引言目前，在高速数据采集系统以及在线测控系统中，为了实现数据采集、处理、实时控制等功能，越来越多地采用多CPU系统。基于多CPU并行处理的嵌入式系统，不仅可以增强系统的控制能力和信息处理能力，提高系统的自动化和智能化水平，而且可以适应各种控制领域复杂的现场环境[1]。在嵌入式多CPU系统中，数据通信问题成为制约其性能提高的主要因素，而双口 RAM的高速数据通信和共享能力为解决这一问题提供了方便【2J。在用双口RAM设计的多CPU并行通信系统中，RAM仲裁机制成为系统设计的关键问题，良好的仲裁机制可以使系统运行更稳图1双口RAM结构简图 (1)存储体定，性能更高。存储体是双口RAM的核心。它由许多存储单元组成，每个 2存储结构及工作原理存储单元都能存储一位二进制数码，这些存储单元被排列成矩阵形式称为存储矩阵。双口RAM存储结构如图l所示。双口RAM通常由四部分