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基于fpga的crc算法的串行和并行实现 serial and parallel implementation of crc algorithm based on fpga
第39卷第10期 合肥工业大学学报(自然科学版) V01．39No．10
JOURNALOFHEFEIUNIVERSITYOFTECHNOL(K；Y(NaturalScience)Oct．2016
2016年10月
DOI：10．3969／j．issn．1003-5060．2016．10．013
基于FPGA的CRC算法的串行和并行实现
肖艳艳，何晓雄
(合肥工业大学电子科学与应用物理学院，安徽合肥230009)
摘要：在数字数据通信系统中，由于信道传输特性不理想以及噪声等干扰，常常会出现一些异常情况。因
此，通常在数据通信中添加循环冗余校验(cyclicredundancycheck，CRC)码，可以大幅度提高通信韵可靠性。
文章在论述串行CRC实现的基础上，对电路结构提出了改进的方案，实现了基于现场可编程逻辑门阵列
(field
programmablearray，FPGA)的CRC的串行2、4、8位和并行算法，并用超高速集成电路硬件描述语
gate
circuithardware
言(very-high-speedintegrated descriptionlanguage，VHDL)实现CRC校验，将实验结果下载
到DE2，验证了方案的可行性。
关键词：循环冗余校验码；串行算法；并行算法；超高速集成电路硬件描述语言；现场可编程逻辑门阵列
中图分类号：TN919．1 文献标识码：A 文章编号：1003—5060(2016)10-1362-05
Serialand ofCRC basedonFPGA
parallelimplementationalgorithm
XIAO
Yanyan，HEXiaoxiong
(sch00IofElectronicScienceand of 230009，China)
AppliedPhysics，HefeiUniversityTechnology，Hefei
datacommunication channeltransmissioncharacteris-
Abstract：In tothenon-ideal
digital systems，due
ticsandthenoiseinterference，someabnormalsituationoften inserial
appears
the check(CRC)checkcodeinthedatacommunicationcan improve
addingcyclicredundancy greatly
the ofcommunication．Onthebasisofthe oftheserial
reliability analysis
circuitstructureis andthe bitsserial algo—
improved proposedtwo，four，eightalgorithmand‘parallel
rithmof CRCcheckis
CRCbasedonthefield
progr
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